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jitter仿真及解决

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发表于 2008-3-5 10:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
众多周知,即便最优秀的IC,从设计之初就注定了jitter的存在,环境因素的影响又使jitter变得复杂和不可预知。有效的jitter控制会是一件富于挑战且趣味横生的事情。) H, {  w0 _& c3 p  S; m: H1 G7 R
( d/ T# B' V3 s2 x0 Q1 W+ ]
Total jitter(TJ)可划分为deterministic jitter(DJ)和random jitter(RJ)* r! q$ n2 V! ^* ~+ g% u; g4 \

& c: Y% c! W5 O9 ^& x当然组成DJ的jitter有:(data dependent jitter)DDJ,(periodic jitter)PJ/ T/ X- s5 o% }! O5 y& Q
4 J, v5 v# @/ j0 O" m
DDJ又可分为:(inter-symbol interference)ISI及(duty cycle distortion)DCD
0 w+ k% V8 ]  q4 W- s8 MPJ可分为:(sub rate jitter)SRJ和uncorrelated PJ; F5 a, [1 k( B' v6 h
8 A$ j3 ?  y+ v
RJ的产生是不可预知的,我们的工作应该集中在DJ的产生机理及处理方法的研究4 C+ h% G! j; h2 B

6 i7 K5 ^1 m. r; `3 _问题:(针对于DJ来讲)
% W  f) A# }* e9 A3 N% R1.如何确定各类jitter的产生机理?
5 D5 P& Y) q/ J6 p: |9 E+ }2.如何有效抑制各类jitter的发生?
+ {/ F; p5 c" x4 O3 Y3.现有何种仿真软件对jitter分析有一个相对细致可靠的结果?
) O. {  M; ^' h6 }. m4 Y
8 o( d4 K% Q9 a' m
[ 本帖最后由 forevercgh 于 2008-3-5 10:24 编辑 ]
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sagarmatha

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发表于 2008-4-17 22:10 | 只看该作者

同问

希望高手指教  关于各类抖动的仿真 有相关资料最好

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发表于 2008-5-10 09:08 | 只看该作者
RJ的产生是不可预知的,我们的工作应该集中在DJ的产生机理及处理方法的研究PCB论坛$ e5 u. L" Q# I: a4 u7 x" V6 F/ s1 V2 _8 l3 T* {
+ ^" D0 k  P( P! K
T% ~' b; F: \: u, D0 Y) V2 P
2 z6 H( T1 G/ L1 [. |' }+ k1 _1.如何确定各类jitter的产生机理?2 j" Y; z, A- a, \+ Y% [; }
2.如何有效抑制各类jitter的发生?
EDA365专业PCB设计论坛网站|PCB layout设计|高速PCB设计|SI|PI|EMC仿真设计2 C  R2 C* o( D6 r% Q" [* H: ~# A; _. G
3.现有何种仿真软件对jitter分析有一个相对细致可靠的结果?PCB论坛$ Q) O1 S+ |! M, m% \+ |( E# i  u$ Q

$ v8 P' S3 X  X/ s" L6 J
/ x) T5 v2 m& H8 l/ x1 X6 n为什么没有人回答啊 ,急求相关答案

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 楼主| 发表于 2008-5-10 09:45 | 只看该作者
诚实的讲,当初这个问题提的太大了。
* T4 I4 N2 R; F! G4 D1 e, n; I' U试图通过仿真软件来实现jitter的分类剥离也是不合实际的。
, S8 x1 O+ q6 B" w1 l4 b5 H一般SI软件的仿真器中的jitter成分都是要自主添加了,只是为了尽可能的接近实际效果。' g- c9 O7 u$ |" n6 C
一般的芯片手册中都会讲到其jitter大小,当然,这个jitter是固有抖动,我们是无法消除其影响的。7 F* a$ J. B: D; M
而实际系统可能会受到串扰,反射,EMI等因素的影响引入其他抖动。) N3 k% r' M, l, O" I
4 Z) {2 B# [. O) X
深入的了解jitter的产生机理和消除途径事实上应该算是一个技术分支,记得maxim有一篇讲解jitter的文档,不妨搜搜看。) [8 P+ ?4 X8 s) A* R1 F
# z$ r$ \5 ~  u* m/ s  _! ]) R3 v. `

( \; p0 E& X) G0 y所以最好的办法就是拿实际的示波器来进行probe分析
" S0 Q2 y) F. x1 F3 `9 H7 P6 K
) d8 ^+ z$ ]$ }* L5 q& [  R1 Q% K8 n2 b/ B+ t  Z
PS:你的示波器带宽一定要足够,采样频率>=2信号频率# e  a' ]. `1 p" F* M
        你的系统频率是否需要考虑jitter因素
sagarmatha

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发表于 2008-5-10 14:45 | 只看该作者
示波器带宽选择是否应该考虑f3db而不是2信号频率

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 楼主| 发表于 2008-5-10 21:25 | 只看该作者
2倍信号频率的问题纯粹是从理论上讲的极限。根据Nyquist采样定律,被测信号的最高频率的每个周期理论上至少需要采两个点。不然会造成混叠。
/ Y/ k7 Q( ]3 z% t" B# Y0 K# Q而实际示波器的的采样频率远不止2倍信号频率,采样频率越大也就意味着采样点越多,那么得到的信号波形可信度就越高。采用线性插值算法,一般需要10个点。所以一般采样率是带宽的4-5倍可以比较准确的再现波形。" q% A0 \9 e: S3 `

0 Z# S( ~5 W' i' S9 c示波器的带宽是以正弦波幅度衰减-3dB的频率点间范围为定义的* r$ q' y/ d9 F4 R

1 c- u9 \) }0 k$ d% n0 n[ 本帖最后由 forevercgh 于 2008-5-10 21:28 编辑 ]
sagarmatha

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发表于 2010-4-8 12:15 | 只看该作者
“示波器的带宽是以正弦波幅度衰减-3dB的频率点间范围为定义的”这句话的正确理解是这样的,功率衰减3dB,幅度下降到0.707。其次,需要注意的是频响曲线-3dB转折点的方式,高带宽示波器尽可能的是Brickwall响应,对应的带内是Flat。

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发表于 2010-4-8 12:22 | 只看该作者
1.如何确定各类jitter的产生机理?
! i1 u' t7 l4 C# Z1 j8 \  {' N) s这个其实是看格jitter分量的本质,以及是如何叠加(调制或耦合)到信号中去的  B/ s% u' Y0 g+ f: F# ]% {
2.如何有效抑制各类jitter的发生?2 }$ ^& B' S: A
首先jitter的各分量分离出来,然后有针对性的从源头解决。比如Pj,假如是时钟泄漏和电源谐波,则需要分别做好对时钟的屏蔽和EMC工作。
6 g& p6 S3 p& z8 v3 I" Z* K6 o7 m  w0 Y6 ]" g
3.现有何种仿真软件对jitter分析有一个相对细致可靠的结果?7 F5 O/ L# g! N/ f3 H
软件仿真总是在理想情况下,但可以仿真极端情况,适合stressed 测试,ADS由于可以和Agilent的众多测量仪器无缝集成,相对要占优。但事实上,完全可以抓取到数据后在任何一个仿真软件中进行仿真。
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