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FPGA做IIC主设备的问题

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发表于 2014-4-15 09:28 | 只看该作者回帖奖励

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诸位好，现在的设计是这样的，FPGA做IIC的主设备，一片1.8V的芯片，一片3.3V的芯片，均为从设备，2个芯片的IIC管脚均接至FPGA的2个普通I/O，这样问题就来了，1.8V和3.3V电平不匹配。那能不能改成这样，将1.8V芯片的SCL、SDA管脚接到1.8V的BANK内，然后从3.3V的BANK内接出SCL、SDA并与上述的2个普通I/O对接。这样可以么？

求大神

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发表于 2014-4-15 09:38 | 只看该作者

是这样的，记得SCL和SDA配置成OD就可以了。

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楼主| 发表于 2014-4-15 09:49 | 只看该作者

part99 发表于 2014-4-15 09:384 h8 ?2 l0 Z: @+ Y
是这样的，记得SCL和SDA配置成OD就可以了。

可否再具体点啊？感激不尽！

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发表于 2014-4-15 09:54 | 只看该作者

ych634227759 发表于 2014-4-14 20:498 o4 G1 _% y C$ J; `
可否再具体点啊？感激不尽！

你能否具体点告诉大家你用的是什么FPGA啊? 感激不尽！

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楼主| 发表于 2014-4-15 09:59 | 只看该作者

part99 发表于 2014-4-15 09:54
4 ^* O1 n" x, C& c你能否具体点告诉大家你用的是什么FPGA啊? 感激不尽！

Xilinx公司最新的7系列FPGA，具体型号为XC7K410T-2FFG900！多谢啦！

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发表于 2014-4-15 10:56 | 只看该作者

直接用两个I2C不完了么，一个接1.8bank一个接3.3bank

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楼主| 发表于 2014-4-15 11:10 | 只看该作者

dongyaming 发表于 2014-4-15 10:56
[2 ]2 U6 s0 c4 I, R直接用两个I2C不完了么，一个接1.8bank一个接3.3bank

这样的话是不是对时序什么的有要求，复杂了点吧？

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发表于 2014-4-15 11:14 | 只看该作者

ych634227759 发表于 2014-4-15 11:10# v9 i+ L- |3 v+ r
这样的话是不是对时序什么的有要求，复杂了点吧？

在FPGA内复制两个I2C_MASTER，各自管理1.8V从机和3.3V从机，硬件上互不影响。

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楼主| 发表于 2014-4-15 14:07 | 只看该作者

dongyaming 发表于 2014-4-15 11:14' n/ \# x3 a4 t) M+ t4 L% a2 q
在FPGA内复制两个I2C_MASTER，各自管理1.8V从机和3.3V从机，硬件上互不影响。

OK！！

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楼主| 发表于 2014-4-15 16:18 | 只看该作者

caseyxie 发表于 2014-4-15 14:109 E! x- [& r4 \3 e; r7 x0 v
哎。。。搞个电平转换电路很难吗？
3 x! `+ z; _- }如果你的3.3V设备认为1.7V电压也是高电平的话，就直接连接咯！

1.8v对于3.3V设备来说肯定不是高电平啊~~

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楼主| 发表于 2014-4-15 18:30 | 只看该作者

caseyxie 发表于 2014-4-15 18:160 j* V$ H- y2 E
那就直接上电平转换电路！+ k s1 J& `" X y/ m4 N
不过如果1.8V设备内部是真正的OC的话，可以考虑直接3.3V上拉。不保证能上到生 ...

很可惜啊，1.8V设备内部不是OC门啊。！！

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发表于 2014-4-15 20:52 | 只看该作者

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