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ALtera MAX II CPLD 擦写次数问题

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发表于 2016-1-17 20:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请教一下,下面列出的100 Cycles Erase and reprogram,是不是指MAX II CPLD最多只能擦写100次?是的话,100次未免有点少了吧,谢谢2 t" ]" i& X; N( S5 p
& G1 S+ u" ?. K4 p( k

0 v& g! `- s7 i4 ^' p/ Q; p- _3 O4 b* S
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发表于 2016-1-17 21:59 | 只看该作者
Lattice MACH 4 也一樣!
& n- o: M& E1 J0 D/ ^5 H; o
2 D4 s1 ^& l% |  z

MACH 4 Endurance.jpg (38.5 KB, 下载次数: 0)

MACH 4 Endurance.jpg

点评

谢谢,版主总是这么勤勤恳恳! 以前用FPGA时没在意过烧写次数的问题,现在觉得CPLD只能擦写100次有点少。请问CPLD擦写超过Spec规定的次数(比如100次)之后再烧写会出现什么现象?是烧写失败,还是能烧写但不再可靠  详情 回复 发表于 2016-1-17 22:16
哈士奇是一種連主人都咬的爛狗!

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 楼主| 发表于 2016-1-17 22:16 | 只看该作者
超級狗 发表于 2016-1-17 21:59
5 ^. C' G8 m( V: t! XLattice MACH 4 也一樣!
, b/ U6 u+ D. Z" G, J
谢谢,版主总是这么勤勤恳恳!2 a, z2 A9 x6 c" |8 k8 E
以前用FPGA时没在意过烧写次数的问题,现在觉得CPLD只能擦写100次有点少。请问CPLD擦写超过Spec规定的次数(比如100次)之后再烧写会出现什么现象?是烧写失败,还是能烧写但不再可靠?这个最大烧写次数应该不是Altera厂商可随意控制的吧,应该是芯片硬件制造本身决定的吧?因此100次是不是安全起见而规定的保守次数?我在网上看到有人说在实际应用中CPLD擦写次数远不止100次,不知版主有没有过亲身实践证明?9 w* O0 D& Q8 W& ?* G% B

点评

是的!我以前用 Altera CPLD 也沒太注意,燒到壞掉的好像也不多見。 不過 CPLD 的價格還不算太貴,燒壞就當消耗品吧!  详情 回复 发表于 2016-1-17 22:51

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发表于 2016-1-17 22:51 | 只看该作者
zzzljb 发表于 2016-1-17 22:16( s' A6 H8 r: R' ?5 A0 f, v- d
谢谢,版主总是这么勤勤恳恳!1 ^' F+ k' f$ X; z! c
以前用FPGA时没在意过烧写次数的问题,现在觉得CPLD只能擦写100次有点少 ...
% s- G2 B9 R  H' p9 ?9 p. A
是的!我以前用 Altera CPLD 也沒太注意,燒到壞掉的好像也不多見。, Q2 w: H. r; y8 J
, Z+ ], l& O+ o1 n  M$ g: ^
不過 CPLD 的價格還不算太貴,燒壞就當消耗品吧!
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发表于 2016-1-17 23:06 | 只看该作者
曾經碰到損壞的現象是,燒錄完在驗證Verify)時會失敗,應該是芯片中某些單元Cell)已經磨損了,就和閃存Flash Memory)的狀況類似。* q" i$ M# z' l/ T& G9 X

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