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EDA365电子工程师网»技术社区 › 电子技术社区 › FPGA/ASIC/CPLD论坛 › DDR ip内核例化不成功
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DDR ip内核例化不成功

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徐财源

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发表于 2018-4-25 13:49 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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quartus ii 13.1 在做DDR例化配置IP核时，到最后一步一直不动，无法配置成功。请各位大神指教指教！
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asdf193

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发表于 2018-4-25 14:00 | 只看该作者
什么错误，发上来看一看啊~

点评

徐财源
就一直停在这个界面了  详情 回复 发表于 2018-4-25 14:18

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徐财源

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 楼主| 发表于 2018-4-25 14:18 | 只看该作者
asdf193 发表于 2018-4-25 14:00
. D9 V) J! v* ~0 b什么错误，发上来看一看啊~

0 b; _6 U! {) W  G- F1 O' B& k就一直停在这个界面了
, h: ^# ], K8 ]1 F, m- Q

QQ截图20180425141826.png (26.58 KB, 下载次数: 0)

QQ截图20180425141826.png

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