香雪海 发表于 2012-11-27 14:15 % _0 G6 `4 O% X: O9 p2 A5 @2 L
你覆铜的间距设的大了肯定都避让了,自然会不完整,你别设那么大就可以了,另外出错的话要看是什么错误,不 ...
yinning 发表于 2012-11-28 09:59 6 e; I8 D5 q" G6 ?
怎么可能是5mil呢?你说的不是内电层的覆铜吧,如果是,我认为可以的,我说的是表层的覆铜,线与线间距理 ...
yinning 发表于 2012-11-28 09:59 - h- i- M+ J# t$ c, i' Y( R% u" P! _
怎么可能是5mil呢?你说的不是内电层的覆铜吧,如果是,我认为可以的,我说的是表层的覆铜,线与线间距理 ...
yinning 发表于 2012-11-29 09:37 1 `/ p. d2 Q9 v1 r+ c) F
工艺上当然没问题,我现在想知道大家在表层覆铜的时候,有没有遇到类似的问题,shape to line,shape to v ...
欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/) | Powered by Discuz! X3.2 |