EDA365电子工程师网

标题: 从AD09到cadence16.3的不适 [打印本页]

作者: xianrui1989    时间: 2012-11-11 20:34
标题: 从AD09到cadence16.3的不适
   本科乃至读研期间一直用AD09画电路板,在经历过多次的画板错误之后,终于适应了AD09,AD的3D可视其实是一个很不错的工具,后来我也渐渐发现了AD的一些毛病,不规则焊盘很难解决,内部的一些规则我研究了很长时间才弄明白。比如说焊盘在内电层的连接设置,一些安全间距的设置。但是,这些都在走上工作岗位之后变的一无是处,对AD的使用时间过长,在转用Cadence之后,变的很难适应,虽然我画的板子密度没有内存条那么大,但也有十几个FPGA在上面,Cadence在画板时,网络标号不在引脚上,长时间使用AD的我,总是习惯性的把板子放的很大,去找网络标号。对于内电层(负片)的连接问题,更是搞不明白,搞不清楚花焊盘怎么使用,搞不清楚动态铜皮和静态铜皮,搞不清楚为什么负片还要普通(AD中负片直接画分割线就可以了)。这么多的疑问,弄的我现在项目进展很慢。真诚的希望有看到这个帖子的朋友,告诉我怎么才能快速的摆脱这么为什么呢!!!!!
作者: rx_78gp02a    时间: 2012-11-11 23:23
这个是正常的,我从mentor转allegro也是觉得allegro有非常非常多的不合理的地方,但是用久了会觉得allegor真心强大,虽然有不足的地方,但是是可以克服的。
作者: yangyabo02    时间: 2012-11-12 08:55
我也有同感,到现在还没有勇气放弃AD转用Allegro,慢慢转吧,总是需要一个过程的,这个谁也帮不了
作者: wangzhe19831    时间: 2012-11-12 09:27
忘了ad,重新来过.cadence慢慢就熟了
作者: yangjinxing521    时间: 2012-11-12 09:37
都读研了,画板子就不是你干的活了。。
作者: xlzhu    时间: 2012-11-12 10:11
顶下楼上
作者: xlzhu    时间: 2012-11-12 10:12
本帖最后由 xlzhu 于 2012-11-12 10:14 编辑
- J6 ~* Q( L" X2 U* X2 U+ p6 o' i/ W: S2 P( _2 f: }7 p, V; e; \. W: q
应该说画板子不是你主要的活,但是懂是应该的,软硬兼修嘛!研究生应该侧重算法或软件吧。7 A; H( y2 G& m. n$ @( m. q

, o  m8 [( b& a* z, P像画板这样的苦力活还是交给我这样头脑简单,四肢发达的人来做好,别来抢我们的活!不然我们怎么活?
作者: zzlhappy    时间: 2012-11-12 11:28
我也有同感,之前用的是PADS,现在正准备往cadence转,觉得好不适应!!
作者: Able    时间: 2013-8-22 14:42
适应就好了
作者: lanlingshan    时间: 2013-8-22 18:44
只要有好的途径和方法,现在资料挺多的,转过来也挺快的
作者: xiahang    时间: 2013-8-22 20:21
16.6版本可以显示网张名了,
作者: xianrui1989    时间: 2013-8-25 09:38
xiahang 发表于 2013-8-22 20:21' @* _/ `1 n& ]* l( e+ F
16.6版本可以显示网张名了,
; u; b/ ]0 w* V5 _* C, F  y
恩,不知道破解怎么样!
8 T+ a  c+ G1 Y1 d, U4 |




欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/) Powered by Discuz! X3.2