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标题: 在PADS Logic转到LAYout中怎么检查电气性是否正确和匹配 [打印本页]

作者: 铁神    时间: 2011-9-6 09:51
标题: 在PADS Logic转到LAYout中怎么检查电气性是否正确和匹配
在PADS Logic中怎么检查电气信号。通过什么方式像Protel99中那样显示出来电路是否连接正确(电气连接线是否完好和元件PCB封装是否正确),笔者遇见画好原理图转入PCB时,不知怎么检错,而且自己画好的封装导入到PCB中找不到器件?
作者: 铁神    时间: 2011-9-6 10:36
各位高手指教,在acsii文档中的显示
' D1 m5 G7 ?" l: \' e$ k*Part name not found U1
, B. n7 l2 C6 m* ^: \- }C9.2 C7.2 C6.2 U1.7 U1.9
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R21.2 Q6.C D16.K U1.5
+ `7 D% s( h! c*Part name not found U1
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*Part name not found U1
. g. x1 D' ~) Y* s: rQ2.C D8.K R9.2 U1.2
6 [. M% U* q' n9 h0 p*Part name not found U1/ u: ^. a& X, e3 |7 @
Q3.C D10.K R12.2 U1.3
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8 Q" |& W! A& |3 S$ Z*Part name not found U1. p* u  J  ]' F0 f( i- R1 h& R' k
Q1.C D6.K R2.2 U1.1
5 |9 u, y# _( _. ^: t$ ^9 G. |**INPUT WARNINGS FOUND**
7 }0 P- N8 g' K2 H) u在原理图是中bom中有U1器件(自作的10P排针),导入到Layout中就没有U1的影子?
% t& I# Y+ w2 p3 d" G' J+ H求解!多谢
作者: jimmy    时间: 2011-9-6 10:37
1,logic生成网表后,导入PCB时,会提示相关的错误.
# r! _+ G+ I1 @4 w$ @! U2,找不到封装,是库路径没有指定好.FILE->LIBRARY
作者: 铁神    时间: 2011-9-6 10:45
jimmy 发表于 2011-9-6 10:37
/ i4 t" F( A% K1,logic生成网表后,导入PCB时,会提示相关的错误.
+ d& i) C1 H! A: k2,找不到封装,是库路径没有指定好.FILE->LIBRARY
4 q+ D) c' m/ [! v8 P
1、会提示相关的错误,是怎么检查!7 R) M) f+ z0 Z
2、这个封装是我在制作Logic元件库的时候配对加载进去
作者: jimmy    时间: 2011-9-6 10:51
1,你在PCB界面,导入asc时,软件会自动弹出相关的信息8 q, h: y- m- Y$ F: s
2,你在PCB软件这里也是要将对应的库加载进来的.
作者: 铁神    时间: 2011-9-6 11:28
jimmy 发表于 2011-9-6 10:51
+ Z, V0 E; X; |, i1,你在PCB界面,导入asc时,软件会自动弹出相关的信息
+ s0 R8 Z* U/ F- Q2 J0 I2,你在PCB软件这里也是要将对应的库加载进来的.
: x% [7 ^# W$ m6 j! ?+ `
多谢版主{:soso_e183:} ,问题解决了,我加载的库没有没有在同一个路径下面
作者: jimmy    时间: 2011-9-6 11:41

作者: xxlljj    时间: 2011-9-6 20:33





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