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标题: 有没有人设计过4片DDR的？ [打印本页]
作者: dzwinner    时间: 2011-8-16 13:39
标题: 有没有人设计过4片DDR的？
最近设计了一款4片DDR的产品，感觉最难的就是地址线了，大家说一下用router如何设计这类走线？& r& |- u6 y3 q
我在设计时length 指示的是trance的长度，而不是pinpair的长度，感觉很不方便，大家有没有什么好方法，或者告诉我如何在router里只指示pinpair的长度？
/ Q" Z( M: a( S: H8 [
作者: lxizj    时间: 2011-8-16 16:24
1.地址线你可以考虑做成 T+菊链的形式。我最近画的四片DDR的板子，就是这么做的。DDR1-DDR2-CPU-DDR3-DDR4。
/ T) c6 c( G& @8 s2.router也可以看pin pair，跟layout一样。把项目管理器点开，net那个地方。
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5 @5 ~; [. \2 {' }$ e
作者: dzwinner    时间: 2011-8-17 09:48
lxizj 发表于 2011-8-16 16:24 / Y: u/ i$ l3 a* S
1.地址线你可以考虑做成 T+菊链的形式。我最近画的四片DDR的板子，就是这么做的。DDR1-DDR2-CPU-DDR3-DDR4。 ...

2 O! }7 p: P, r谢谢指点，兄弟可不可以把PCB 放上来给我学习学习啊？当然你可以把其他电路删除一些，防止泄露公司机密哈！
' @9 O5 W& Q0 w0 m$ ]6 P8 Y
作者: lxizj    时间: 2011-8-18 14:31
本帖最后由 lxizj 于 2011-8-18 14:32 编辑
9 y' j/ G. W! e$ s& W, g
dzwinner 发表于 2011-8-17 09:48
2 e$ X* R/ r/ F; `+ n谢谢指点，兄弟可不可以把PCB 放上来给我学习学习啊？当然你可以把其他电路删除一些，防止泄露公司机密哈 ...
& d; A$ m$ b8 R; g

& Z& f" Q6 K" ]. n DDR3_4x8bit_6Layer_V1.1 20110623.rar (164.98 KB, 下载次数: 1320) 附件是4片8位DDR3的板子，你可以参考下 0 a) t5 e* M$ O, T0 f3 ~6 h
PS: PADS2007版本的
作者: caiyongsheng    时间: 2011-8-18 17:48
楼主可以注意自己的是ddr,ddr2 or ddr3哦。因为他们所使用的拓扑结构是不一样的。1 F5 a  E9 b6 V$ m3 A6 X6 ?* a
ddr,ddr2使用T形拓扑,ddr3用fly-by,即所谓的菊花链状的拓扑结构，如下图所示：
9 P. y+ I. a2 _: n' J' t7 E7 f
作者: 1_home    时间: 2011-8-19 08:56
这里好人就是多啊
作者: dina8561900    时间: 2011-8-19 09:32
谢谢楼主分享！
作者: dzwinner    时间: 2011-8-19 13:49
caiyongsheng 发表于 2011-8-18 17:48
* j- G: e% M- x, ?楼主可以注意自己的是ddr,ddr2 or ddr3哦。因为他们所使用的拓扑结构是不一样的。7 z$ ]' ^4 U* n7 p1 L0 k! ^
ddr,ddr2使用T形拓扑,dd ...

& v  n4 E% i  B  }: Z我是DDR2的，就是T 型拓扑，DDR3还没设计过。
作者: dzwinner    时间: 2011-8-19 14:49
本帖最后由 dzwinner 于 2011-8-19 15:19 编辑 ' {# j$ t+ M% R) }8 I8 z6 q' h" F
lxizj 发表于 2011-8-18 14:31
" f/ o9 z! v; j; S附件是4片8位DDR3的板子，你可以参考下 ! N) z/ J" t4 f: N
PS: PADS2007版本的

) g" v1 m3 ^# W! R; _$ M. ~$ F% a# F7 F8 E% p1 S' {9 C" {
谢谢你的PCB文件，我看了下，很漂亮。DDR3的，单面摆件。走线很美观，看着就是一种享受！呵呵！
( Y! W: H' g& [不过还是有一些问题，希望多交流共同学习。, B2 y! {6 @$ v: m9 _! [
1、这款DDR3 有调试过吗？能跑起来吗？
# ]" x. |% A4 [) ~7 x, H0 T2、几组DQS 和时钟线都没有严格按照差分线来走，差分的两根线没有等长，是不是DDR3不严格还是楼主没来得及优化？0 |, \9 k: `' m7 c* Z
3、楼主是纯手工在router下画的吗？ 在调整地址线长度的时候你是怎么做的？: _7 g6 b% d. j/ f" ~) y; Q
如图A11 和A5是不一样的走线方式，过孔数不一样，这样没关系吗？/ L- T; g* T8 S; u  y9 y3 O
A5
$ ^' {: `# M7 ~1 m) wA11( w6 r# @* O9 G2 r
我截了2个图片就是地址线A11和A5的，上面每一段trance我都标记了一个数字。我有些疑问
1 C! z" s+ h3 Y/ b- {1、比如A11中的走线，我理解的等长是保证 1+3=1+2，1+3+4=1+2+5 ，然后其他DDR3的PIN出来的那一小段走线4片DDR3都等长！) E9 g$ ^- t$ N+ D3 y
2、A11与其他的地址线如何等长，是网络等长还是 pinpair等长？即上图中的 1+3=1+2    1+3+4=1+2+5？4 y, [2 j" h9 ]+ Y
$ ?% g: p9 h7 c0 Z3 G6 H. G1 f7 G& E

3 v  K% Y1 b) D- r$ W* G! `3 C  a重点来了：如果我理解没错的话，那么在软件里需要怎么做才能更方便处理这些等长？如果靠自己手画，去计算就有点太麻烦了，这是我最想知道的！

A11.gif (59.76 KB, 下载次数: 2)

A11.gif

A5.gif (64.24 KB, 下载次数: 0)

A5

A5
作者: dzwinner    时间: 2011-8-19 14:52
本帖最后由 dzwinner 于 2011-8-19 15:19 编辑 5 P9 r& |. b$ C. h" w

$ P& C  [& K: z3 A) c截图太难搞了，我语言表达又不好！搞死人了！2 J0 a; N0 C4 \" Z; X1 E: g
: Z1 D4 z! U! k5 d" p7 p
" D1 h% j+ x  k5 \/ J

A11.gif (59.76 KB, 下载次数: 0)

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A11.gif (59.76 KB, 下载次数: 0)

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作者: dzwinner    时间: 2011-8-19 15:10
本帖最后由 dzwinner 于 2011-8-19 15:20 编辑 0 e2 R4 W" S1 \' `
6 o$ Q; q+ G) R
搞图片把我搞的头大了2倍，一点心情都没了！

A5.gif (64.24 KB, 下载次数: 1)

A5

A5
作者: con12345    时间: 2011-8-19 15:14
本帖最后由 con12345 于 2011-8-19 15:14 编辑 1 |8 J' ]* I" G3 H( g8 ^
* {+ D% Q. g6 D
图怎么都显示不出来啊？
3 I* X- ^# ]* J. ]* K5 @看不到，很费劲
作者: lxizj    时间: 2011-8-19 18:18
dzwinner 发表于 2011-8-19 14:49 " `2 f, c( L% N/ F4 p
谢谢你的PCB文件，我看了下，很漂亮。DDR3的，单面摆件。走线很美观，看着就是一种享受！呵呵！
! ~8 g4 N- j+ v, e) c  X$ ]不过还 ...

" G: ~& v. _2 \) U* Y( z; k/ q1、这款DDR3 有调试过吗？能跑起来吗？, p; a/ y2 \, E4 G, f9 C- `) \: F6 j
答：已经调试过了，最高是可以跑到530MHz左右，但是想跑稳定不死机的话，大概只能跑到500MHz左右，具体的测试报告我还没收到。$ D7 C2 ^! n& g; |' U6 F0 o
4 @2 ?7 \& a5 u
2、几组DQS 和时钟线都没有严格按照差分线来走，差分的两根线没有等长，是不是DDR3不严格还是楼主没来得及优化？
/ n# i2 h  S/ ?- r答：DQS的话，是根据数据组等长，并不是完全等长。比如DQS0是与DQ0-DQ7等长，DQS1与DQ8-DQ15等长，但DQS0与DQS1本身并不等长。* m  t/ y! X  D% R/ J) c
至于时钟线的话，是因为主控的问题，在IC设计上，如果想要稳定的话，CLK必须比ADD，CTRL长1100-1300mil左右。这个跟具体芯片有关系，并不是通用的。  U! A: `5 A2 c' ^
9 E# Q) P0 h4 l2 H+ A
3、楼主是纯手工在router下画的吗？ 在调整地址线长度的时候你是怎么做的？
$ b! f/ y& i  L# S, i, L9 H如图A11 和A5是不一样的走线方式，过孔数不一样，这样没关系吗？
0 W' x8 K" v8 K- T+ x% L答：首先，是纯手工布线的，通过计算pin pair的长度来调整地址线长度。& }) M; X4 E# a9 o6 q: o. v# ]
其次，A11比A5多了两个过孔，长度上虽然匹配，但事实上考虑了叠层换层部分走线后，其实长度是有些差别的。但是问题也不是很大，因为从延时上来看，大概相差了6ps。我看到的资料中，信号线时延差在+-10ps内都是可以接受的。9 s$ r% ~# v+ x# J. J
9 F  g- O* R3 o1 v8 I& L5 y$ h
: C8 R  r$ j* z+ ]' S3 m# t& f' M
$ t' T! k& D, ]1 f
4.我截了2个图片就是地址线A11和A5的，上面每一段trance我都标记了一个数字。我有些疑问; J* B2 N4 X+ j
答：我看不到图片，但大致知道你问的是什么。我的拓扑是U12-U14-U1-U15-U13.我保证的是U14-U1-U15等长，然后尽量保证U12-U14与U15-U13等长。是pin pair等长，不是网络。
/ _  C9 Y3 a7 D" i3 `) G( ?( ^2 f: Z3 E4 d. W( n1 k/ t; R
重点来了：如果我理解没错的话，那么在软件里需要怎么做才能更方便处理这些等长？如果靠自己手画，去计算就有点太麻烦了，这是我最想知道的！+ L) c( m$ T9 M, k
答：这个其实比较无奈，我现在就只是靠手画，手动计算，还没有其他方法。如果以后有其他简单的办法，我们可以再讨论。
作者: dzwinner    时间: 2011-8-22 09:15
lxizj 发表于 2011-8-19 18:18 ' S4 j( U$ ~% t" Z' P1 t
1、这款DDR3 有调试过吗？能跑起来吗？. T3 O0 r3 @5 g4 D
答：已经调试过了，最高是可以跑到530MHz左右，但是想跑稳定不死 ...
. ~8 O7 W- `! q& W
恩，了解了！看来路还很长，一起加油吧！
作者: 毒女    时间: 2011-8-22 14:57
我看到4个DDR  地址线走成是这样 就笑了. * I+ a8 ~* D1 S1 j
作者: lxizj    时间: 2011-8-22 16:15
毒女 发表于 2011-8-22 14:57 2 J6 u8 T% n/ M; t) d) Q
我看到4个DDR  地址线走成是这样 就笑了.
: f" `  w7 M. x& t
啥意思？{:soso_e132:}
作者: 毒女    时间: 2011-8-22 17:03

' W0 d  y! M3 Z/ c5 [6 D4 e3 F- f 我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多一个过孔. 我用了少一个过孔的方法,描述了4个DDR 同一根网的等长.  因图是借用上面的图,,所以大家不要看数字,看颜色就好啦: y9 u6 F# z3 m( i

3 @3 q$ R" y/ P$ v* D最左边的DDR长度等于:红色高亮+天蓝色长度+橘黄色
! p2 H7 [& f9 Y3 R# \2 N% A$ I最左边的第2个DDR长度等于:红色高亮+天蓝色长度+草绿色                               
1 l5 q, C' j4 R$ J* c最上最的第4个DDR长度等于:红色高亮+粉红色长度+浅蓝长度               
. s  B+ Z0 _+ b& ~第3个DDR长度等于:红色高亮+粉红色长度+白色长度                                1 H& Z9 v" L. S' L
作者: yufangh    时间: 2011-8-22 17:25
毒女 发表于 2011-8-22 17:03
  K2 e" Y+ E" I* o我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...
, J' e, z" t8 E; t' y; w
正解，要是再详细说下设置规则就完美了！！！
作者: dzwinner    时间: 2011-8-22 18:03
毒女 发表于 2011-8-22 17:03 # J$ u# Z; o% P- z! _8 m9 T
我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...
% W, U: f' l( D& s6 k% l
这个我理解！不过在PADS里面涉及这样的等长很麻烦。特别是这一根和另一根等长的时候就更难搞！我现在在学candence 那个软件处理这个就方便多了，可以设置T点，长度也好控制。验证了那句话，PADS只适合中低端。高速电路板还是candence好用。
作者: 毒女    时间: 2011-8-22 23:55
dzwinner 发表于 2011-8-22 18:03
2 O+ \5 {1 `, H; w2 m这个我理解！不过在PADS里面涉及这样的等长很麻烦。特别是这一根和另一根等长的时候就更难搞！我现在在学 ...

8 E* V& W  \1 w4 O7 {好讽刺哦8 v; N+ z$ Q/ g4 R6 V& p4 R% g
你既然理解，怎么还有那样的图呢 6 f1 Z  ^, K5 [2 H$ t
* Z; b9 p/ U7 \/ Q
长度麻烦 那是走线的时候，没走好才会出现管脚对不是你想查的， 就算F5不好查，在ROUT里面 也有查走线 线断。 可以综合表格来，表格这个东西你懂吧填个数据自动求和，。无非就是地址线和控制线比较难测，也没有多少根， DDR 导表格 用半天时间也不过份吧。 也是对产品认真负责。
作者: caiyongsheng    时间: 2011-8-23 09:58
长时间工作，这块4片DDR3的板子不出问题，就是奇迹，至于你信不信，我反正信了。
作者: benking    时间: 2011-8-23 10:39
lxizj 发表于 2011-8-16 16:24
: P" |4 {. ]% X$ x7 I: L1.地址线你可以考虑做成 T+菊链的形式。我最近画的四片DDR的板子，就是这么做的。DDR1-DDR2-CPU-DDR3-DDR4。 ...
) O$ |' b2 N( Y* m
你这好像是telechips的demo。
作者: lxizj    时间: 2011-8-23 12:36
caiyongsheng 发表于 2011-8-23 09:58
7 ^) ?7 A& P: ^长时间工作，这块4片DDR3的板子不出问题，就是奇迹，至于你信不信，我反正信了。
5 R, y; t* v  z. n5 p  r3 W
呵，想知道这位朋友基于什么理由，判断这个片子长时间工作会出问题呢？
! @" h) X3 g# ?: Y4 v是指拓扑结构吗？{:soso_e132:}
作者: lxizj    时间: 2011-8-23 12:40
毒女 发表于 2011-8-22 17:03 0 F- j1 @, f! u# a6 A' O5 p
我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...

/ c: W& o9 q, @$ Y' F) ?看毒女解释时图片的打过孔位置，你画多片DDR用的是这种拓扑结构吗？
8 A5 O( @) ~! ^6 Q. [# X) J
作者: caiyongsheng    时间: 2011-8-24 09:31
lxizj 发表于 2011-8-23 12:36 ; `( {* _5 R8 L5 g
呵，想知道这位朋友基于什么理由，判断这个片子长时间工作会出问题呢？
( P1 w" W+ V0 P) q- e是指拓扑结构吗？
: E/ M3 M7 k% t) |" A" D
是的，做DDR3，不要再停留在做DDR2的思想上了，原则性问题。
作者: donkey    时间: 2011-8-24 19:55
设计过，星型布线
作者: lxizj    时间: 2011-8-25 09:28
caiyongsheng 发表于 2011-8-24 09:31 8 Y+ c* Z  a  E' H. |( j, E
是的，做DDR3，不要再停留在做DDR2的思想上了，原则性问题。
0 W. r. C& c1 p$ H
caiyongsheng，我想请教两个问题。
9 g8 y* ?7 L9 x) E) V1.  如下图的fly-by拓扑，在layout的时候，1.2.3.4部分分支线应该是尽可能的短是吗？1 `& F; Z* v# W( j. r: t
2.  5.6.7三部分有没什么要求，比如等长之类的？5 |: `0 y' Q7 b: D5 n6 d
作者: caiyongsheng    时间: 2011-8-25 09:59
楼上. y$ r0 D& |+ D- Y: d6 P/ J( N
1，最好不要出现1，2，3，走线经过M1，M2，M3的焊盘最好。
) {- _% P: V7 o* z/ @" z2，5，6，7当然要做等长，最好控制在100mil以内，元件到元件的线长最好不超过1inch。
作者: lxizj    时间: 2011-8-26 09:58
caiyongsheng 发表于 2011-8-25 09:59 ' K) B  n; ?" }9 X3 Z% t0 h
楼上( H# P% z! }. V2 J* t
1，最好不要出现1，2，3，走线经过M1，M2，M3的焊盘最好。
- i8 w: d4 ^! l2 B% m2，5，6，7当然要做等长，最好控制在100m ...

; O8 |6 r* F' u- L! j受教了，有空我把板子改一版试试看性能，方便的话能不能帮我看看？
作者: caiyongsheng    时间: 2011-8-27 00:38
楼上,OK
作者: jweiok    时间: 2011-8-27 09:53

8 p$ s9 y4 T# U( E5 S请教 Router只能打开pcb、bre格式的，怎么会有的asc格式文件
作者: caiyongsheng    时间: 2011-8-27 12:24
jweiok 发表于 2011-8-27 09:53
+ B( o7 {' n: Y; L4 c$ t请教 Router只能打开pcb、bre格式的，怎么会有的asc格式文件

$ m' v( M. V+ [4 D$ q9 s在pads-layout里面import选asc文件导入.
作者: mark007    时间: 2011-8-29 10:30
做了将近3年的FAE，最近又想做回产品硬件开发，得跟大家学习了！
作者: caiyongsheng    时间: 2011-8-31 22:18
mark007 发表于 2011-8-29 10:30
0 U- }8 x! J1 f3 m! R做了将近3年的FAE，最近又想做回产品硬件开发，得跟大家学习了！
# O9 S* M* G5 t9 `% F1 B/ \
FAE好啊,怎么又不想做了,至少比较轻松,而且可以经常出去,以后还有更多的机会做市场.
作者: dzwinner    时间: 2011-9-2 09:26
毒女 发表于 2011-8-22 23:55
( x! e1 L# ?8 U/ j) K% e) W0 D好讽刺哦: u/ Z# U4 s$ U+ K- A1 [) T
你既然理解，怎么还有那样的图呢
& Z# a) K2 ^( \6 w# N* D+ \5 D
我是说楼主的话我理解了，而不是说之前就知道，明白？你口气好凶哦，俺是新手，希望个人高人对待新手要有耐心。+ \' d* S9 o) J
谢谢你的指点，用表格，是一个思路！
作者: zhouchengxiang    时间: 2011-9-5 00:18
   四个DDR可以这样布局，你的空间很是奢侈啊，羡慕！
作者: shen945    时间: 2011-9-5 09:34
真是高手云集啊！学习了，最近也画了一块6层板子的 心悦4颗DDR的板子！要求很高！结构限制，原厂说无法做出阻抗匹配，也就此作罢！
作者: 332109959    时间: 2011-9-5 11:03
受教啦
作者: CFG    时间: 2011-9-5 13:28
高手多呀，学习中
作者: zlq0416    时间: 2011-9-13 19:33
毒女 发表于 2011-8-22 17:03
9 h! }+ M8 o* N) A+ K6 ^9 ]我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...
# m, _  D6 D* x1 I+ m7 b8 e( K- a
毒女无敌！
作者: wojiushiljg    时间: 2011-9-13 20:06
好多资料，学习了
作者: mark007    时间: 2011-9-22 16:51
努力学习中！
作者: mark007    时间: 2011-9-22 16:54
caiyongsheng 发表于 2011-8-31 22:18 : Y# K5 y( t% W
FAE好啊,怎么又不想做了,至少比较轻松,而且可以经常出去,以后还有更多的机会做市场.

+ [3 U2 m9 z# J+ i兄弟！FAE工资不高呀！因这事最近比较纠结，决定明年做硬件设计了。
作者: caiyongsheng    时间: 2011-10-13 10:44
mark007 发表于 2011-9-22 16:54 7 A+ k1 B4 z* ^# ~9 M
兄弟！FAE工资不高呀！因这事最近比较纠结，决定明年做硬件设计了。
& w  n3 N" U, ^0 }: l- P1 q. N3 a
大哥，你毕业几年了？FAE的工资一般在多少呢？
作者: chelsealy    时间: 2011-10-18 10:36
学习了
作者: ai小叶    时间: 2011-12-30 12:46
lxizj 发表于 2011-8-18 14:31 3 D( z, K8 s+ l' I- }& r" U
附件是4片8位DDR3的板子，你可以参考下
* o/ ?; R% f3 }* I! x9 m1 E5 X6 A  \. ~PS: PADS2007版本的

" k, m2 W3 v: R) I. i5 i太给力了，谢谢！！！！！
作者: elcoteqcaoming    时间: 2011-12-30 15:53
高手如云，学习中
作者: lisaliang0520    时间: 2012-6-19 16:28
下来看看
作者: ruqin606    时间: 2012-6-19 16:58
回复才能见吗？
0 i- M' w. s2 O: k2 _  `
作者: ruqin606    时间: 2012-6-19 16:58
ai小叶 发表于 2011-12-30 12:46   K( W+ J: Y; m* ^' E8 E; x
太给力了，谢谢！！！！！
3 U) E8 e# G$ x7 z6 X( v- X

" r" ?+ W( ^" @0 w+ C{:soso_e150:} 看错啦
作者: icebluexiong    时间: 2012-7-7 12:45
谢谢分享
作者: sunny_wfh    时间: 2012-10-9 23:37
看看
作者: 花心刺猬    时间: 2012-10-10 09:59
caiyongsheng 发表于 2011-8-25 09:59 , W: X2 S" w/ u1 A, O  p. ^4 M5 y# S! ^
楼上
8 I7 [) ~' y+ g% f0 X: u4 }! d1，最好不要出现1，2，3，走线经过M1，M2，M3的焊盘最好。
/ p9 y% ?2 J# a& A/ c5 P# W7 j2，5，6，7当然要做等长，最好控制在100m ...
. W& q; \- z, w! @0 ~$ W
呵呵，有可能不出现1，2，3吗？就算BGA引线，严格来说也是非常短的1，2，3吧！
作者: wyb546024278    时间: 2012-10-10 11:07
学习了！！！
作者: 冠少H    时间: 2012-10-10 11:43
学习了！！！
作者: nantanke    时间: 2012-11-9 16:30
学习了( o4 X! C) a' c' K# a
作者: baoshiyan    时间: 2012-11-10 22:50
这个拓扑结构是错的！
作者: flyover    时间: 2012-11-12 11:00
DDR3也可以走成T点的，只是占用更多的内层
作者: dzwinner    时间: 2012-11-12 15:25
毒女 发表于 2011-8-22 17:03 - s3 Z( [/ H- Q$ \$ ]
我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...

6 y5 q9 K* K1 H+ U6 p- X- ~经过一年多的时间！现在也对这个有所了解了！其实对DDR3来说T型拓扑和菊花链型拓扑都是可以的！
作者: dzwinner    时间: 2012-11-12 15:28
一年后的今天再来看这个帖子！感受颇多！从曾经的一窍不通，到现在的一点点的熟悉，走了很长的路！疑点心得就是：理论知识，必须学，但板子真正自己画了之后才能真正明白。
作者: 血夜凤凰    时间: 2012-11-12 21:40
上八段 与下八段 中抽头
作者: 血夜凤凰    时间: 2012-11-12 21:45
原则性问题是先CLK 再数据 最后地址 有4块AM 原则上是最少孔数的 CLK优先级最高 两组与两级间误差因该不能超过DATASHEET手册数 否则想象下你左脚长右脚短 如果用在视频产品上就会出现严重的马赛克 以前画板时硬体工程师偏要那样要求 结果搞出来的PCB做出来就有这个问题 报废了100块板子
作者: bevingeng    时间: 2012-11-13 14:56
我也在进行LPDDR2 PCB LAYOUT,学习。
作者: 南林维京    时间: 2012-12-21 13:56
留名；
7 F- E2 v1 j0 p, L3 G; d8 y' Y  论坛里哪位老师，能开个关于DDR方面的课啊； ! C* m2 z. ~; O0 q  o
那时应该会很火的喽，
作者: 8051a    时间: 2013-1-10 20:59
装B的人特别多，DDR走对称树叉型大把人知道，问题现在数码产品方案都用四层板，板子还特别小，知道怎么做也要有空间做再说吧！！地址线多点拓扑还要导什么狗P表格，PADS本来就能像ALLEGRO那样做到指定引脚对等长，不懂多学学去吧
作者: zjg473    时间: 2013-1-11 09:30
这个帖子的讨论很有分量，对新手有很大帮组
作者: wyb546024278    时间: 2013-1-11 10:10
学习了...



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