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orcad同步到allegro的问题

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发表于 2011-1-14 15:48 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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各位高手,请教一个问题,在下将一个orcad和pads完全同步的原理图和PCB,想转成orcad和allegro文件之后再同步,已修改完很多问题后,能生成网络表,但是不能同步到allegro,强行同步后,所有的无件丢失,但走线还在,manual place里面提示所有的元件处于未放置状态,在同步的时候提示下面这些问题
4 {- Y( G4 ^" u( M# h9 N! ZWARNING: P7 component device pin number mismatch; cannot replace.: e/ M# Z3 j/ ^+ ]9 o' N+ m
#1   ERROR(SPMHNI-191): Device/Symbol check error detected.2 H% t( v3 C; H* @$ X
ERROR(SPMHNI-197): Symbol 'C0501' for device 'C_2_C0501_100U/35' has no refdes.
4 W* T1 {' f' R) L#2   ERROR(SPMHNI-191): Device/Symbol check error detected.$ u  a% ~3 h; s1 R) X4 X) {" R
ERROR(SPMHNI-197): Symbol 'C1004' for device 'CAP_C1004_470U/35' has no refdes./ ^3 X4 W. K9 S+ h. n* ^
#3   ERROR(SPMHNI-191): Device/Symbol check error detected.
" r$ v- ?& ^8 @8 Q- y* O* ^2 x" m4 d4 B" G& `' @* z7 \8 u( f
请问各位大侠出问题的原因是什么,怎样解决???
8 a/ r* u) O+ U0 y- b在小用的是cadencd16.3
( g  n+ {8 b2 o, R/ f( F6 U8 s$ x
; R) r2 M' S8 z% K1 A
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发表于 2013-3-1 17:54 | 只看该作者
祝自己在的新的一年里,开心快乐多,伤愁离别少。

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发表于 2011-1-27 08:42 | 只看该作者
ding

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 楼主| 发表于 2011-1-24 14:56 | 只看该作者
导入pads格式的PCB 导入到allegro之后再与orcad格式的原理图同步的全过程经验总结6 p9 ~  z  S8 }
步骤
( n  Q* G/ r3 C% }: _8 Q: q  T1,先将orcad原理图与pads PCB严格同步,同时保证pads的每一种元件的库都有元件序号和值的label(两个label),不然会出现同步allegro传送网络表时会出现没有标示的问题
% [: r4 j' M1 t  m+ s' f2,pads输出powerpcb3.5格式的asc文件
  R! \7 ?: L- H! x; T  t3,在allegro里面导入asc文件
# F' |; r" L( a. ~- k( A4,在allegro导出库文件
1 \+ i9 d( W( m4 Q0 _, u' a7 r5,在用户设置里面,设置焊盘和flash的两个库文件的路径,都指向刚从allegro导出的库
, y  v9 W, U( b, f/ v# x" B6,打开orcad,输出网表,选择要同步的allegro PCB,并指定要生成的allegro PCB
* i, |% g- u* P( A* a3 P0 u7,执行同步。(此过程会产生很多问题,大部分的问题原因是,8 s4 h( S( s2 h& _
                           原理图的焊盘个数与PCB库焊盘个数不一致,   修改原理图,保证与PCB库一致
4 s  ~) e4 e8 `                           原理图封装信息也PCB不一致或有非法字符 如。+?、/等符号,重新修改原理图封装信息,并保证与PCB库一致
6 `. d8 b& O& @$ ?                           原理图库元件信息里面的路径信息也不能有非法字符。+?、/等符号,解决此问题只得重新做库和调用cadence/ T( u- N' p- l1 H; B' G
                           源库替换掉原来有非法路径信息的库元件
! @% w. K. s5 D7 v0 I1 p* g' I                           元件的引脚也要严格区分,如某个引脚定义为output 则该引脚不能连到地。这也会造成同步失败
6 l6 f/ B! h  S  A                           元件的引脚名和引脚号不能分别不能与另一个引脚有重复的部分)1 m. y9 i  i: {  r0 L9 s! v% M

, v0 }& A  u9 `$ d% [$ G+ n& B# r+ d" R) t

点评

归纳下,就是借用不同软件的库文件,再正常导入设计。这也是各种不同软件设计杂交设计的标准方案,而布局文件及走线可以后期导入。当然库文件都是需要优化的,特别是走pads->allegro流程的转换方法。  发表于 2013-3-1 18:14

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发表于 2011-1-14 22:11 | 只看该作者
Symbol 'C0501' for device 'C_2_C0501_100U/35' has no refdes.
: t5 [3 O! v* y=======================================/ o8 B0 X6 R# Q& [& k  p2 X
请问你是看不懂英文还是怎样?
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