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原理图检查没错,也可以生成网表。但是导入网表的时候出现以下错误!!!

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发表于 2010-8-8 12:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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(---------------------------------------------------------------------)
) x$ ^: ~$ `! |/ i9 f(                                                                     ). w/ p# X! G1 E7 w3 G
(    Netrev Allegro Import Logic                                      )
9 }0 K' Q2 [: P(                                                                     )! v9 q, g7 U0 m9 s1 k4 P- p# I3 j
(    Drawing          : tmt.brd                                       )
- b" i6 x$ u2 ^- t/ P/ e/ v$ O(    Software Version : 16.3p004                                      )
& O, X% ?- U# N% ]+ k  ?. p(    Date/Time        : Sun Aug 08 12:12:28 2010                      )
$ [) e  g* E0 J7 Z7 W  F  ]% A(                                                                     )
& j& N4 A% H! L2 P* |) y(---------------------------------------------------------------------): C: H* V% D- C/ K6 L! `  R' T( Y

7 M0 @9 J7 ^5 m3 C7 F
) d" Y) |& j: r6 B% y3 r9 y------ Directives ------2 ~: }$ i) }) T/ w! d

6 c% N7 C# E% \8 b+ [RIPUP_ETCH FALSE;
$ ^1 a1 |: n4 T" H, I( {3 ~RIPUP_SYMBOLS ALWAYS;
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  x) v/ i, n/ x% m7 [& r% gSCHEMATIC_DIRECTORY 'F:/fuzhitmt';' k7 Z5 f- H# f$ O9 J6 d7 e
BOARD_DIRECTORY '';" `# G( w+ _4 B( B* V& O
OLD_BOARD_NAME 'F:/fuzhitmt/allegro/tmt.brd';
  u8 P. S1 G$ S) v6 T7 Z. K/ PNEW_BOARD_NAME 'F:/fuzhitmt/allegro/tmt.brd';5 l. C. t" E# |

3 O$ ?3 Y* M6 d  s! }2 @CmdLine: netrev -$ -i F:/fuzhitmt -y 1 F:/fuzhitmt/allegro/#Taaaaaa03408.tmp
6 I0 C! d8 C% I" v, F+ y" n' A, c
' i0 e, c, h8 G! g- U' Y& N------ Preparing to read pst files ------% B5 u" q2 E4 `& f0 _% I& |

$ d3 p# d4 G+ N$ i8 S+ L) v1 U' a: b" PStarting to read F:/fuzhitmt/pstchip.dat 3 }5 N3 S0 d1 l5 u# }
   Finished reading F:/fuzhitmt/pstchip.dat (00:00:00.21)+ [% N* N# x, p" b2 P
Starting to read F:/fuzhitmt/pstxprt.dat
9 ^" @3 H7 H. ?. J( \2 T   Finished reading F:/fuzhitmt/pstxprt.dat (00:00:00.00)$ O  X( h2 g8 R- E. S
Starting to read F:/fuzhitmt/pstxnet.dat
4 B& @  N% i/ X. _" b) v* \+ B3 J  g   Finished reading F:/fuzhitmt/pstxnet.dat (00:00:00.01); J( _7 j% V) o9 |* p6 J

# Y( |0 m& C3 B8 I; E------ Oversights/Warnings/Errors ------
* z6 Y; J) @8 N* l) x% f6 d2 s  |: a9 @5 @) ~/ _) U
9 y9 I. G+ m* S1 H
#1   ERROR(SPMHNI-191): Device/Symbol check error detected.0 F  m: O* X: @9 u3 O

$ `* v- E+ a7 W2 M- yERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '6'.
: p5 d( t4 d& V
1 Z/ h6 C6 G4 ~- N- n$ wERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '5'.
$ e2 N/ @. H( s- K6 s4 v4 h- j% @8 B9 q5 A- Y7 _# U, f) q
ERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '7'.
3 y; A" e3 Q  \/ A
. q( T  C2 d2 q0 L* a5 T6 P6 w* PERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '9'.
; S3 u2 ]( X) e
4 a$ z: s$ F8 T1 b5 ^7 C# hERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '10'.
6 D2 f/ B( c6 p) _2 m* S8 `/ R. ]6 E" X9 M9 R# `/ X
ERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '8'.
! M1 W% h4 M" m
' T0 N% D/ m& vERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '13'.( q5 ?* v, g% v. u+ v) ^& l- j1 s
2 z& @( ~$ a6 a1 t
ERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '12'.$ J  B* c/ T# g
1 _9 [( m, t% X, W6 v
ERROR(SPMHNI-195): Symbol 'SOT23-3' for device '2N6988_SOT23-3_2N6988' is missing pin '14'.
: Q% \1 ]" Z0 \  r4 c! B- ~) U4 k  T" x5 u% I9 q9 {* N  C4 B
------ Library Paths ------8 |3 p- H* _# t) V+ n! J
MODULEPATH =  . 5 s) ?; N2 e# r) ?* ]/ B2 T1 u
           D:/Cadence/SPB_16.3/share/local/pcb/modules 5 {# S# @4 |3 [3 c& s7 b  ], v3 _7 {
) h) x- U0 H5 i, m% v
PSMPATH =  . ( n; f% h& W) T3 ~9 N
           symbols
2 Y% ]( t. [& G& h; K3 u) s; P           ..
  N$ d2 Q9 l0 D0 ]" P* @0 [$ n           ../symbols : {' {/ C% Q( X, Q7 K
           D:/Cadence/SPB_16.3/share/local/pcb/symbols
. P4 ?4 v6 R* N" r5 e           D:/Cadence/SPB_16.3/share/pcb/pcb_lib/symbols . q/ O9 n0 g  e1 j* M# z$ K; o
           D:/Cadence/SPB_16.3/share/pcb/allegrolib/symbols
5 g1 ~2 L1 O6 s6 c. C           F:\fengzhuangxinxi\TMT\
, \. i( \/ c1 e9 e& S           F:\fengzhuangxinxi\TML\
/ ^7 b- b3 `# b- o/ w# ?9 w* A" D% I& z$ s0 }1 J$ x2 K# W. a" Y1 y
PADPATH =  . 8 n! C! M+ K2 W" [' Q. G" S. H# t" \
           symbols
7 g0 [, h! W# b' I( _% A- v9 x           ..
7 Q) P  r% J* ]1 S( W           ../symbols ! y8 C$ k4 K0 r* y$ D, b6 S  U
           D:/Cadence/SPB_16.3/share/local/pcb/padstacks % y1 A5 e+ u3 R8 X0 A! F
           D:/Cadence/SPB_16.3/share/pcb/pcb_lib/symbols
; x% q# b. T( A/ r3 `3 j" I7 Q           D:/Cadence/SPB_16.3/share/pcb/allegrolib/symbols * k6 K5 F) Q0 R- P; O4 i4 w
           F:\fengzhuangxinxi\TMT\
/ V& A. g& _) ~  w1 V( N           F:\fengzhuangxinxi\TML\ 0 E9 x/ E) C8 P1 O: h, S. w
# `- a  o: q1 Q9 c; [0 a, p
' ?0 p6 e6 v: C: [  c  v' _
------ Summary Statistics ------
  n# Q2 p9 \% {. w  Z# F0 z
  U2 I( Q. x& j" x& I8 ]' g5 O
. n4 z0 S8 \8 q0 |#2   Run stopped because errors were detected2 ]0 |* g: q  V

, G. A- N+ M5 ]/ J5 Wnetrev run on Aug 8 12:12:28 2010
! @& o6 _/ h' C( C   DESIGN NAME : 'TMT'
, v3 P. W5 `8 W4 x5 v- I" }   PACKAGING ON Nov 17 2009 03:09:43% h+ ~& Y) c# ?! n

( w& j! g  `7 N+ ~4 ]   COMPILE 'logic'
+ B0 b% N4 c( R; q) l& ]   CHECK_PIN_NAMES OFF3 D7 y. Q; G0 w8 V6 {9 D- s
   CROSS_REFERENCE OFF% B# a7 ]! y# P/ F" ?; j
   FEEDBACK OFF
  ]8 B5 Z- t- j" c   INCREMENTAL OFF
& E0 `) l& ?1 T& B* c   INTERFACE_TYPE PHYSICAL/ d* {7 Z: n$ t+ U
   MAX_ERRORS 500% b) q. i" ~% r3 F4 k6 N* r. }
   MERGE_MINIMUM 57 @& a' j# v) {8 S9 w) q
   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|', o: @/ O" w. ^$ M/ M
   NET_NAME_LENGTH 24
! k7 A8 l. h  J# f/ D4 P) e   OVERSIGHTS ON* [' j& ^' Q2 l' x. ?" f7 v
   REPLACE_CHECK OFF9 m# K5 N8 F2 K
   SINGLE_NODE_NETS ON
/ x5 H, }6 P. C/ O% L& j9 l4 O   SPLIT_MINIMUM 0
3 s3 P8 n9 P5 N6 f5 Y  R   SUPPRESS   20* q: k, a  [# M8 R' U% v: z1 }
   WARNINGS ON
" B3 C% u1 U( C, c: O% }# x- Q1 t8 M; U# y) k
  2 errors detected
) W% @4 H$ L, |, x1 p( rNo oversight detected/ g5 @7 A& j" V% l& O* o2 T
No warning detected
$ h* u5 V# B* V* Q& Q- B+ I# D1 s8 ^
cpu time      0:02:36' U$ w, w7 K9 F5 T# N' ?9 s
elapsed time  0:00:02
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 楼主| 发表于 2010-8-8 12:14 | 只看该作者
好心人帮忙解决一下
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发表于 2010-8-9 09:24 | 只看该作者
SOT23-3封装的器件,原理图sym和footprint的pin脚定义不一致

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发表于 2010-8-9 10:37 | 只看该作者
封装的问题, \" M8 h: [1 I+ A, `* l
我也遇到过

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发表于 2010-8-9 10:37 | 只看该作者
建议重新做封装 肯定没问题

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发表于 2010-8-9 11:38 | 只看该作者
原理图与PCB封装不一致。。
) _( j8 |$ K* g' f9 V% q如果封装库不是自己在弄的,这种问题很常见。

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 楼主| 发表于 2010-8-10 09:17 | 只看该作者
回复 3# neuneins
: e; }2 ?+ k; i6 c0 W- _% B- X$ N& P) ^, v8 M$ ^
6 T; K0 n' q- F- E
    谢谢
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 楼主| 发表于 2010-8-10 09:18 | 只看该作者
回复 4# lwh123468
' t' |! U# e+ @( m* K% k' T; K& p  X1 ]0 m8 O8 ^; G3 N7 b& F+ L
# M+ M; R) b. Z6 f
    我试试啊,谢谢了
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 楼主| 发表于 2010-8-10 09:18 | 只看该作者
回复 6# lanxinzyf 0 I7 Y& Z2 c8 T: ^& q3 x5 S

9 `$ A1 v$ p7 z! }
9 S6 L: ^5 B6 d' D$ h' d    我确实用的不是自己的封装库,唉~~~
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发表于 2010-8-10 10:34 | 只看该作者
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发表于 2010-8-10 19:14 | 只看该作者
哈哈,常見的問題。
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