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标题: Cadence支持全新TSMC WoW高阶封装技术并扩展对TSMC InFO和CoWoS封装解决方案的支持 [打印本页]

作者: Cadence_CPG_Mkt    时间: 2018-5-9 10:57
标题: Cadence支持全新TSMC WoW高阶封装技术并扩展对TSMC InFO和CoWoS封装解决方案的支持
本帖最后由 Cadence_CPG_Mkt 于 2018-5-9 10:59 编辑
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内容提要
中国上海,2018年5月2日 – 楷登电子(美国Cadence公司,NASDAQ: CDNS)今日宣布,完整的Cadence® 数字,签核及定制/模拟 IC设计工具,与高级 IC 封装技术现已支持 TSMC 全新晶片立体堆叠(WoW)3D堆栈技术。同时,Cadence为TSMC的三位系统单晶片(CoWoS)与集成扇出(InFO)后端技术提供扩展工具与方法支持。全新Cadence WoW设计流程及增强版CoWoS和InFO设计与分析方法为设计团队提供了集成并封装一个或多个晶片的新方式。
如需了解Cadence支持TSMC WoW,CoWoS及InFO技术的详细内容,请参阅www.cadence.com/go/wowcowosinfo

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WoW 高级封装技术支持

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在CoWoS技术基础上,WoW 支持3D立体堆栈,适用于面积更大晶片尺寸,以及更密集的I/O接脚数。Cadence的工作流程、工具及设计方法可以帮助TSMC客户管理顶层互联,验证芯片集成解决方案与整体设计流程的一致性。

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Cadence优化了现有工具链的相关产品,为实现WoW芯片集成技术提供完整的集成工作流程:
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InFO及CoWoS增强

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Cadence同时为TSMC现有的InFO及CoWoS技术进行了增强。Sigrity XcitePI提取现为插入器和TSV子电路提供RC SPICE模型支持。此外,Cadence SiP版图也开始提供高密度晶圆级冗余金属(DM)生成。SiP-PVS DRC集成现包括DM界面,并支持LVS,帮助设计师提高效率。
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“Cadence对TSMC解决方案的支持已有很长时间的历史,我们为TSMC WoW 技术提供的最新支持可以帮助设计工程师在更大、更复杂的设计平台部署 3D 技术,并进一步缩短上市时间,”Cadence公司高级副总裁兼定制IC/PCB事业部总经理Tom Beckley表示“我们对InFO和CoWoS技术的持续支持进一步展示了我们与TSMC的紧密合作,我们将一如既往的确保客户获取所有最新技术,实现设计目标。”

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“全新WoW参考工作流程是我们现有InFO和CoWoS芯片集成解决方案的必要补充,为客户采用2.5D和3D技术将大尺寸晶片与更密集的I/O接脚集成提供更高的灵活度,”TSMC设计基础设施市场部高级主管Suk Lee表示“Cadence对我们封装技术的有力支持至关重要,帮助我们的共同客户将解决方案的优势发挥到极致。”

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关于楷登电子 Cadence
Cadence公司致力于推动电子系统和半导体公司设计创新的终端产品,以改变人们的工作、生活和娱乐方式。客户采用 Cadence的软件、硬件、IP和服务,覆盖从半导体芯片到电路板设计乃至整个系统,帮助他们能更快速向市场交付产品。Cadence公司创新的“系统设计实现” (SDE)战略,将帮助客户开发出更具差异化的产品,无论是在移动设备、消费电子、云计算、汽车电子、航空、物联网、工业应用等其他的应用市场。Cadence公司同时被财富杂志评选为“全球年度最适宜工作的100家公司”之一。了解更多,请访问公司网站 www.cadence.com

作者: zltwin    时间: 2018-5-15 10:51
学习了




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