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标题: 急!!求救!!Verify design 检查出错!!附图 [打印本页]

作者: hrt8100    时间: 2008-12-15 23:38
标题: 急!!求救!!Verify design 检查出错!!附图
    verfy design 检查 fabrication项时,提示有三处错误,其中二处电阻处提示错误,急望高手解答,
- A  ]" I; y: E+ X; c+ ^' T8 ~; q- S( \3 j
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万分感谢!!!附图!!

求救.jpg (72.86 KB, 下载次数: 5)

求救.jpg

作者: hrt8100    时间: 2008-12-15 23:46
朋友们快点进来吧!!!
作者: hrt8100    时间: 2008-12-15 23:47
等着你们来救命呢
作者: hrt8100    时间: 2008-12-16 00:03
朋友们都睡觉去啦!!
作者: 桃夭    时间: 2008-12-16 10:15
标题: 这个是间距问题啦
在设置层定义里面设置下或把间距拉大点就好了,检错里面应该也有提示的
作者: wzkkao    时间: 2008-12-16 14:46
我都不检查fabrication!
作者: wzkkao    时间: 2008-12-16 14:47
还有楼主是不是自动布线呀?怎么感觉那些线乱乱的!
作者: junfeng    时间: 2008-12-16 21:54
是呀,我也没有检查过fabrication!




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