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标题: Layout Design Guide [打印本页]
作者: qiangqaz    时间: 2017-9-29 16:25
标题: Layout Design Guide
C:/Users/Administrator/AppData/Local/YNote/data/qiang9011@163.com/3d4b19fd4d9f47a88f14a86b6d0b14d0/clipboard.png狗大的资料，有点没看懂，麻烦大家解答下  q# f; B6 N5 Z
1.为什么走线的时候不在过孔处直接转弯？这样走线宽度变化不是更小？
! U6 V5 s+ G% A2.高速GND的回流为什么不是最短回流路径？
* h. f* T) ]( S; ]& }" p# x  V: h1 V4 j" I6 B

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QQ截图20170929163327.jpg

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102492-layout-design-guide.pdf

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作者: steven    时间: 2017-9-29 17:35
很久很久以前，Allen总版主解释过第二个问题（帖子找不到了），因为图左边的回流路径只是直流电阻最小的路径，对高速信号而言，它要找阻抗最小的路径回流，就是右边那个图中的路径。
作者: 波可_kjrGb    时间: 2017-9-30 09:20
学习
作者: qiangqaz    时间: 2017-9-30 09:53
狗大能否解惑？您挖的坑要负责的哦O(∩_∩)O~
作者: 超級狗    时间: 2017-9-30 10:24
本帖最后由 超級狗 于 2017-9-30 10:27 编辑
0 Y& Y3 e! `( t5 }. O  g  B! H7 B# T1 a/ X6 Q
SMSC 的 Layout Design Guide 是這麼做的沒錯！
+ n7 b3 i9 U" y9 A, Q2 F  ~, \6 y& ?
大哥英明神武、莊敬自強、處變不驚、慎謀能斷、三顧茅廬、三戰呂布、七出祁山、七擒孟獲……
! {$ z# j. j: ]$ e0 R( L- c" U' {8 }3 w0 w1 A1 K
我中華民族之復興指日可待！
5 I$ j+ p7 T5 K) ^  R  e2 R9 B+ c4 e6 s0 k" L
. Y  h- b- e" e0 n% L8 o

SMC Layout Design Guide.jpg (99.43 KB, 下载次数: 0)

SMC Layout Design Guide.jpg
作者: cwfang2013    时间: 2017-9-30 10:24
第一个问题，我也比较疑惑" q( G& y! }( K. x* \
第二个问题，我可以大致说下我的理解，对于高速信号而言，回流必须找阻抗最小的路径，而高速信号的阻抗主要表现为感抗，感抗和电感的大小有关，电感和磁通量有关，最后就是和回流面积有关，第一幅图的回流面积非常的大，而如果在信号的正下方，回流面积会很小
作者: linyuanfei    时间: 2017-9-30 12:59
学习了
作者: 超級狗    时间: 2017-9-30 23:32
提供邪惡美帝的一個實驗，他們在一條 22 英吋長的 U 形走線上，跑不同頻率的訊號，利用電流密度（Current Density）觀察地層回流路徑（Return Path）的變化。
" K1 d& c  q7 J" R
( K  V2 d; ?9 x& d. y: j- W! ~8 |6 }3 j5 x1 c

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Fig.1 PCB Physical Geometry.jpg

Fig.2 Current Density at 1KHz.jpg (16.16 KB, 下载次数: 0)

Fig.2 Current Density at 1KHz.jpg

Fig.3 Current Density at 50KHz.jpg (15.14 KB, 下载次数: 0)

Fig.3 Current Density at 50KHz.jpg

Fig.4 Current Density at 1MHz.jpg (18.03 KB, 下载次数: 0)

Fig.4 Current Density at 1MHz.jpg
作者: xtaylg    时间: 2017-10-1 13:46
很好
作者: 超級狗    时间: 2017-10-1 14:00
回流路徑（Return Path）
. N9 A1 b% a" A5 g3 f$ h3 o
% f+ T5 H! e# v3 r2 M1 U

回流路徑（Return Path）.pdf

621.6 KB, 下载次数: 71, 下载积分: 威望 -5

作者: honejing    时间: 2017-10-1 21:41
1. 理論上的強弱耦合的漸變，應是 layout 不好拉，就變那樣。就看運作的頻率，若是 5GHz 以下，你的想法也可以，差異樣該不大。 5 b/ f% w, r$ i1 r
- `; v" F  D0 c
2. 狗老大已經有說明，補充另一個 3D 說明圖* z/ f, ]  z7 o1 P1 i
1 |8 v+ A$ K) v) v
作者: 番茄酱_cE557    时间: 2017-10-1 22:29
Mark
作者: arod13    时间: 2017-10-2 12:40
以下小弟我個人淺見% O; t  x+ g7 o" w
如同上面大大所說的 高頻是看電感阻抗 在低頻才是看電阻阻抗! j, _# H5 ]. t1 r3 L9 O2 s
影響電感很重要的因素是電流所走的迴路0 B. u% r, Q5 i2 Z/ R2 |. ]
L=磁通量(正比面積)/電流1 ~+ q# J: m' O# L. q
在相同電流下如果走訊號線下方可以發現電流迴路所產生的面積只有板厚乘路徑長度
4 _8 P9 n1 F! M6 B/ p而如果迴流走像DC那種路徑等於增加一段路徑而增加面積) S) l; y, t' O4 l
用下圖(Top View)來說明兩種迴流方式所包圍的面積& I, i; ?7 {: Y3 ~' ], k" a+ \( b
9 S7 ?0 \. M5 K) X6 Z' A: Z9 }
1.High Frequency Return Path: s' _# c5 F( o, `
|--------------------|
( q, Y# D/ O/ X7 `! Q|                       |; t' f3 d7 m/ o" `: x
|                       |0 ?/ ]$ o; F2 `
                  1 _4 S+ b, ?* E) M
2.Low Frequency Return Path (<<<低頻迴流路徑)0 D' @. }3 L- |% f% @
|--------------------|
4 u2 c; G/ X* N/ D+ n9 h|                       |
7 }$ R" [# q1 B6 n$ v|<<<<<<<<<<|2 H% g- ~6 V& P6 @. M- Q# H* t

  Z7 W; ]% A. i0 F( Y2 f) b可以發現低頻迴流路徑(上圖2.)會有比較大的面積
: u5 t- }1 W6 @因此高頻走低電感的路徑必須走上圖1.的方式
- \$ ?# l' ]3 `9 `8 q$ _/ c) A
" M( V0 E1 y9 h. Q小弟為新人硬件工程師如有誤還請各位大大指正
作者: arod13    时间: 2017-10-2 12:45
再補充一下 為什麼高頻會是感性% S/ N) H+ `  J) c; P9 X, }) b) t
Impedance=R+jwL1 ]* R4 D0 i( X) {8 j! K
在高頻時w變大好幾倍時,jwL這項會遠大於R% _: c% f# a, ]. F3 `/ U! P
因此高頻是呈現感性
作者: 看海去不去    时间: 2017-10-10 13:30
第一个问题的原因是什么？
作者: liling92zdh    时间: 2017-10-12 11:40
学习学习
作者: djadfas    时间: 2017-10-13 11:58
C:\Users\Administrator\Desktop\yybb.jpg
作者: enjoy_DpuE3    时间: 2017-10-16 09:55
作者: AD9_PCB    时间: 2017-10-20 10:27
超級狗 发表于 2017-9-30 10:24
9 \- b: q9 v) O- WSMSC 的 Layout Design Guide 是這麼做的沒錯！
# U( J% r2 A* o8 Z: B4 T/ p3 T4 _2 }+ U! T9 ?! q* K
大哥英明神武、莊敬自強、處變不驚、慎謀能斷、三顧茅廬 ...
( K. p2 ?: V  w9 S. e3 m  C
为什么HS走线和ss走线不在同一层
作者: 超級狗    时间: 2017-10-20 11:32
AD9_PCB 发表于 2017-10-20 10:27
$ r! o7 i0 Z# U% X6 E- ^为什么HS走线和ss走线不在同一层

7 K/ W9 D, {6 n老實說，這個問題也不算太爛，我需要再懸賞五兩銀給那個 A 版主來賺嗎？
; n4 @5 e4 F# R! j
. ^" B$ P( ~* c( D* P, V, k1 \6 ?* s  e' K- \$ o
+ |6 T! i6 b- [) Y! M4 g
貼圖看不出在哪一層，附上 SMSC Design Guide 上的一句話。
& i0 E8 |+ U7 {0 o' e$ a* U
( B3 p( h7 W5 cRoute SS traces on outer layers, rather than on inner layers.* _  B" k: R3 r5 T0 E
8 ~, v- B* z7 n
% }7 n; x0 |1 d5 \9 O+ Y
作者: AD9_PCB    时间: 2017-10-20 14:15
超級狗 发表于 2017-10-20 11:32  E3 d7 |/ B8 l3 C
老實說，這個問題也不算太爛，我需要再懸賞五兩銀給那個 A 版主來賺嗎？

- p& C) h/ o" O( `哈哈，我以为有特殊要求呢，我是小白，见谅啊
) w$ g+ x' P; E8 [
作者: px673084941    时间: 2017-10-24 15:58
阻抗最小的路径；磁通量最小的路径
作者: dhhtmqh    时间: 2017-11-15 11:41
这种帖子回复量都这么少，不科学
作者: dhhtmqh    时间: 2017-11-15 11:42
我要下，没威望了怎么整
作者: luhangzhousztcx    时间: 2017-11-20 11:19
关注下啦
作者: zhp1    时间: 2017-12-18 12:01
学习学习学习
作者: qinqinstart    时间: 2017-12-27 17:19
刚看了一份很不错的design guide
作者: luhangzhousztcx    时间: 2017-12-30 16:01
学习啦
作者: 234500317    时间: 2018-2-7 15:44
学习啦
作者: huang8weijie    时间: 2018-5-3 19:15
/ r+ L' i/ j6 \$ `
学习啦



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