yangjinxing521 发表于 2017-9-15 10:050 }- y; @3 l& M! X
MMP
paul_iw 发表于 2017-9-15 10:59$ } F4 } j, A9 Q% ?( H# ]
介电常数是介质的介电常数,不是铜箔的。width是指线宽,因为allegro的这个叠层是可以粗略的算阻抗的
zuoanwind 发表于 2017-9-15 11:36
因为要做仿真,那top层和GND层的介电常数要填多少呢?
欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/) | Powered by Discuz! X3.2 |