12.png (13.9 KB, 下载次数: 0)
lhycmyy_hawk 发表于 2016-9-25 16:467 f9 q$ a& o" l$ r! X, p/ ~1 j X
我的习惯是,顺序如下8 L. ~9 f) U9 o
1,看layout guide
2,看参考设计
fei 发表于 2016-9-26 09:14
收发分层走,能在内层尽量走内层。你的高速线是多少G.你问下硬件哪是收发好像命名没分清。
lhyy511 发表于 2016-9-26 09:07
尽量满足硬件工程师需求吧
不期而遇 发表于 2016-9-27 09:332 h+ @" Y( r& N4 S9 n
同组同层好像是为了满足什么阻抗要求吧
欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/) | Powered by Discuz! X3.2 |