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标题: PADS9.5的原理图导PCB，出现ecogen failed [打印本页]
作者: songzhuxia    时间: 2016-2-4 14:00
标题: PADS9.5的原理图导PCB，出现ecogen failed
将pads9.5的原理图导入pads9.5的PCB中，出现ECOGEN failed。( k6 X( A4 k1 A" E# m' t& p1 w
1.将所有封装全部删除，重新导入又会正确，再次导入就出现ECOGEN failed。9 J6 [+ n/ I6 z8 j9 N. l' X& O  {$ y
2.我已先进行sent net list。但是在进行ECO TO PCB还是出现ECOGEN failed。
( C- v* T0 j- p6 f- ^4 v产生的logic .log文件内容如下：! Q* H! l9 \. t7 c$ t
PADS Layout ECO Generator (Version 6.4v) 2016-2-4 13:49:22
; s9 |7 j" M: O  UCopyright (c) 2003 - 2008 Mentor Graphics Corp. - All rights reserved
, m2 x; I0 b" W2 H# |: C; BCommand line arguments:  -e d:\PADS Projects\Logic.log -u NOT_CONNECTED -r p -a PART,NET -f -l PCB,NETCLASS,NET
  r7 z* x0 g7 [: jERROR: Wrong gate pin data at the line: URT3_CK/T1_BKIN 52.0.U.PB13/SPI2_SCK/USART3_CTS/6 N. N: }& ~; s6 ]" K
5 B0 r& a9 }' `4 d# K- W0 y+ `
8 msec
& e0 f4 M  y; P- ~9 Z$ N7 k+ E+ `1 o  _2 s) X" @
这上面的原件及封装我在另外一个工程上使用是没有问题的。  k4 L. V0 I* H1 f9 @8 x

& h/ p% `; \  }3 g; m& P( v4 @! n. @6 C望知道的伙伴，大侠赐教指正。谢谢5 @; y  X  g. a+ p  ?& S, ^
* Y3 V5 f+ U& z/ g0 N

  s) L6 \! B! Q: g% F# v6 }* ~% x7 X2 m; Y% A6 }
& g5 k; l+ p0 `5 p  S7 L
作者: jimmy    时间: 2016-2-5 09:51
原理图导出低版本的话，再重新导入。! l" v" ~9 c6 J! f) g( i3 n
: ]0 U% D* b' q7 N3 A3 n9 o/ S
有时候，重启电脑和软件也是可以解决。
作者: adwordslai    时间: 2016-2-6 16:58
看起来原理图封装做的不规范
作者: songzhuxia    时间: 2016-2-17 18:25
adwordslai 发表于 2016-2-6 16:58
9 J) |9 `+ P, y$ P+ q看起来原理图封装做的不规范

6 V4 [/ O% H6 i1 I0 c  [9 n0 @的确是一个器件的封装不规范造成的，但是在器件进行eco check时是报告是0个错误。我使用的是PADS9.5的破解版。
7 R3 a. N  m8 o) H. l4 g* l& h& V目前，其他工程的导入是没有错的，附件是该报错器件的封装。; d2 N! ]+ A+ O, Q+ l
望指教，谢谢@jimmy；adwordslai 。
  l: L; }0 I; Z" w8 E0 y

check.rar

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器件封装
作者: songzhuxia    时间: 2016-2-18 10:56
问题已解决，原来是CAE封装的问题。8 d$ y7 \0 H& ]* O! [4 E, l
谢谢大家的帮助。
作者: i265    时间: 2016-3-25 16:35
解决办法 ： 将原理图或者PCB导出低格式然后在导入  
作者: songzhuxia    时间: 2016-3-30 17:47
i265 发表于 2016-3-25 16:35
7 {6 A. l& z1 l+ ^解决办法 ： 将原理图或者PCB导出低格式然后在导入

7 L( Q( `, g6 j+ g+ R1 P是我CAE封装的问题，谢谢帮助
) @9 O  I+ B% C3 ?  C
作者: marco_ma    时间: 2016-8-27 18:27
能具体说明下如何解决的不，我现在碰到同样的问题了。搞半天了。



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