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标题: cadence16.6版本加载一次原理图，部分差分就掉了，得重新加差分规则。 [打印本页]
作者: hhdd    时间: 2016-1-3 22:43
标题: cadence16.6版本加载一次原理图，部分差分就掉了，得重新加差分规则。
cadence16.6版本加载一次原理图，部分差分就掉了，变成单线规则了，得重新加差分规则。哪位高手有遇到过这样的问题，请帮忙解答下。谢谢了！
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作者: 12345liyunyun    时间: 2016-1-4 09:47
盗版软件总有各种问题
作者: 5718366    时间: 2016-1-4 10:31
是不是原理图里面设置了规则，导入到pcb中了
作者: 小小菜    时间: 2016-1-4 10:33
之前也遇到过，可以将线路图里面的电气规则不要传递到pcb里面就可以了
作者: 小崔    时间: 2016-1-4 11:27
小小菜 发表于 2016-1-4 10:33: ]% A) v  c5 W) P  b/ _) n5 I
之前也遇到过，可以将线路图里面的电气规则不要传递到pcb里面就可以了

: o+ z0 r' p0 x& p7 @是需要怎么设置？学习一下
- \5 A* }% @  s- \+ @! l( J
作者: 小小菜    时间: 2016-1-4 12:47
小崔 发表于 2016-1-4 11:270 u( w3 a' U0 b# V* ^. e
是需要怎么设置？学习一下

' K+ {. C- U  W5 A7 a9 M导网表界面set up里面更改
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' j; V) x7 s! _5 m0 _; G2 `! T9 B* o
作者: zhuyt05    时间: 2016-1-4 16:07
标题: 注意不要使用记事本编辑（可能出错），使用UltraEdit编辑
# o+ p3 ^4 b  K0 w, ^
作者: hhdd    时间: 2016-1-13 19:19
zhuyt05 发表于 2016-1-4 16:07

; D5 `  S5 I  ~/ L4 ?4 u这样确实可以解决问题，非常感谢！！



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