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EDA365电子工程师网»技术社区 › 电子技术社区› Allegro&Orcad PCB论坛
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贴片厂发坐标文件需要使用公制 9人参与 usm4glx 2016-1-5 16:11 14 449 蓝色的天口 2016-1-11 09:33
allegro如何report板子上能最小线宽线距 10人参与 attach_img xiaoyout 2016-1-5 11:16 12 2415 yourjun 2016-1-7 16:20
请问BGA的Pin脚间距与过孔大小有什么固定对应关系么？ 3人参与 zsuhh 2016-1-5 11:09 3 672 逍遥剑客 2016-1-6 14:19
请教怎么升级cadence16.6补丁？？ 5人参与 attach_img 不要命的荨麻草 2016-1-5 10:58 5 386 松哥无敌 2016-1-18 14:18
Antenna Vias & Thieving Vias 8人参与 Lancelot1983 2016-1-5 09:08 12 634 Lancelot1983 2016-1-6 08:30
转个贴，关于铺地 12人参与 新人帖 黑_白 2016-1-4 23:02 12 279 黑_白 2016-3-26 21:40
請教高手如何確保差分對走線是等長的? 10人参与 chfanjiang 2016-1-4 19:23 10 554 jyl518 2016-3-22 15:14
PADS转allegro之后无法设置等长 3人参与 attach_img color_ 2016-1-4 16:36 3 459 color_ 2016-1-14 14:13
信号回流路径问题？ 7人参与 杰1111 2016-1-4 15:51 7 347 砰砰小心脏 2016-3-2 19:19
帮忙看看这是什么问题？！ 3人参与 li262925 2016-1-4 15:28 5 711 li262925 2016-1-5 16:29
求助 allegro -nograph -s xxx.psx 什么意思？ 2人参与 mgh99688 2016-1-4 10:38 2 462 mgh99688 2016-1-4 16:15
新人求助一下 5人参与 新人帖 attachment xizhe12593 2016-1-4 10:10 8 186 li262925 2016-1-4 15:40
cadence16.6版本加载一次原理图，部分差分就掉了，得重新加差分规则。 6人参与 attach_img hhdd 2016-1-3 22:43 7 386 hhdd 2016-1-13 19:19
那些DRC错误可以忽略请问 8人参与 attach_img liutianxiang 2016-1-3 15:17 9 320 liutianxiang 2016-1-6 23:02
请问大家LPDDR2+Xilinx FPGA走4层板，是不是风险很大？ 8人参与 zsuhh 2016-1-3 14:59 8 414 rainbowII 2016-1-12 12:59
求教,如何画螺旋形的PCB天线？ 6人参与 attach_img scarecrowli 2016-1-3 11:18 9 662 longzhiming99 2016-1-28 19:05
allegro 有关多层板的焊盘和过孔问题 4人参与 attach_img usm4glx 2016-1-2 12:48 5 981 liuyue 2016-6-2 20:44
DDR3 地址线VTT电阻问题 7人参与 attachment 小七海带 2016-1-2 10:48 9 1024 mancy66525 2016-10-18 13:59
求助 5人参与 attach_img huzf 2015-12-31 17:51 6 186 65770096 2016-1-5 17:10
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视频信号阻抗控制 6人参与 eda1057933793 2015-12-31 14:07 6 450 eie 2016-1-4 16:07
CADENCE16.3 pcb editor打不开，请大家帮助 4人参与 新人帖 gfhjjkkk 2015-12-31 13:47 5 472 change2011 2016-8-7 11:36
DDR布线总结和请教 12人参与 Ztudou2012 2015-12-31 11:33 12 815 jacekysun 2016-1-8 14:35
cadence 安装问题 4人参与 attach_img 紫韵晴天 2015-12-31 10:48 4 198 ms642799785 2016-1-1 14:08
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