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latium design rules exist问题[已解决]

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faiei

发布时间: 2010-2-9 12:42

正文摘要:

本帖最后由 jimmy 于 2010-2-10 12:27 编辑 . r% s: J& c, G9 w; S + S3 R" ~, a8 w. V- S2 m$ l我在用Verify Design中的clearance时提示没有错误，但是有latium design rules exist.....这样一句提示，请问应该 ...

小精灵 发表于 2015-10-8 10:29

我也遇到了，改了设计规则还是不行，铺铜铺到其它网络上了

liujia20082007 发表于 2012-7-30 22:11

请教怎么解决

longfeisky 发表于 2011-2-11 10:58

我也遇到了，我没有设置过差分规则
还有几个clearence error

faiei 发表于 2010-2-9 14:23

多谢了，原来是我的差分信号线有问题

jimmy 发表于 2010-2-9 13:51

元器件规则或差分规则违反，也可忽略。

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