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关于DDR3地址线等长设置问题求教

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发布时间: 2015-9-11 10:11

正文摘要:

本帖最后由 liuxiang5119 于 2015-9-11 10:23 编辑 4 X, S+ S5 u4 I* x$ e 1 w, H- j2 n" l1 F; Q最近在学allegro,参考飞思卡尔官方电路板,对地址线等长有以下问题希望大伙给个结论:# @! J: l! P' I' W- x; r ...

回复

star929 发表于 2017-5-27 17:10
看看
江南电子 发表于 2017-4-24 11:29
跟我想的一模一样,也是碰到这个问题。还有一个我觉得4个分支不应该也是要组内等长吗,实际上他也等长了,只是没看到约束规则,楼主解决了吗?
我要好好学习 发表于 2016-3-14 21:01
学习 学习
johnson7911 发表于 2016-1-19 17:49
学习了
0 S8 {8 Y% {" P3 R9 q' h8 e
liuxiang5119 发表于 2015-9-14 14:59
esyintao 发表于 2015-9-12 14:36
8 r1 p8 ~6 w, c. b0 {  A0 y& \$ ~不知道为什么这样设置,估计是不是软件版本,导致约束信息变化,T形等长设置没问题,但没有跟u1约束信息和c ...

$ [- \1 A; J/ e3 F( A/ F所以现在很纠结,按理说官方板子应该是验证OK的,但是约束规则里边确认没有   . W' T# u/ B3 c9 V9 I, D
官方原版是16.3的版本,我是用16.6打开的,感觉版本引起错误可能性不是太大6 C# F2 y# w+ y5 }# C$ H1 k

6 i: k6 X- q( o7 w5 P: q5 |
esyintao 发表于 2015-9-12 14:36
不知道为什么这样设置,估计是不是软件版本,导致约束信息变化,T形等长设置没问题,但没有跟u1约束信息和clk0的约束,但好像又是做了等长的,但误差比较大

点评

所以现在很纠结,按理说官方板子应该是验证OK的,但是约束规则里边确认没有 官方原版是16.3的版本,我是用16.6打开的,感觉版本引起错误可能性不是太大  详情 回复 发表于 2015-9-14 14:59
流光、溯雪 发表于 2015-9-11 23:33
liuxiang5119 发表于 2015-9-11 17:03( x% R* C& i9 V* z8 W
没人规定ddr3必须走菊花链  另外这个板子是官方出的板子
# l5 c/ J. S2 O! u: {$ W* R: U
好吧,还以为是必须走链式结构呢。
! T2 V& i* D& R8 t% v3 S% a( V
q270350800 发表于 2015-9-11 22:36
一般消费电子都是官方推出来  肯定是经过验正OK的  走什么型式的拓扑 随芯片而异
liuxiang5119 发表于 2015-9-11 17:03
流光、溯雪 发表于 2015-9-11 14:51
+ }% {' K6 X5 C: V, \  d4 x2 mddr3为什么走T型结构?不是菊花链嘛?

6 j7 i- r9 b: O. _没人规定ddr3必须走菊花链  另外这个板子是官方出的板子  N+ z! f0 }# E" N1 N( Q+ j
$ p' ^6 V1 E+ h! ~+ n4 G  ]/ X

点评

好吧,还以为是必须走链式结构呢。  详情 回复 发表于 2015-9-11 23:33
流光、溯雪 发表于 2015-9-11 14:51
ddr3为什么走T型结构?不是菊花链嘛?

点评

没人规定ddr3必须走菊花链 另外这个板子是官方出的板子  详情 回复 发表于 2015-9-11 17:03
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