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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2011-7-8 08:37 | 只看该作者
jimmy, , v! i4 P9 R* W+ N
当地层设为CAM 平面层。选择CAM输出地时,在地层上还需要覆铜吗?为什么我看的一本书上没有介绍地层覆铜,只有在顶层和底层覆铜。知道你是高手。请指点。谢谢。
. L* E5 \. \5 d/ `& ^% B7 P

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高手不敢当. CAM为负片层,只要设置为CAM并分配了相应的网络,如GND后.在这一层可以不用作任何处理. 而TOP,BOTTOM都是no plane.所以要灌铜的话,还得用copper pour进行灌铜处理.  发表于 2011-7-8 11:11

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发表于 2011-7-8 11:23 | 只看该作者
请教,PADS里怎么隐藏某一个标号的飞线呢?

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选中这一"标号",右键,view net进行隐藏或开启.  发表于 2011-7-11 12:05

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发表于 2011-7-8 11:54 | 只看该作者
红土乡情 发表于 2011-7-7 17:53 : d) t2 G- {- ]
回复 jimmy 的帖子$ |: [" {3 n  Z, j! x
: [* [* D: j2 j* J
请教LZ:

5 |7 L5 ?1 |, p: p# R( I是同一个asc文件,PADS9.0导入不只出现警告和错误问题,且打开后发现很多网络都没有了,真搞不懂,烦请LZ指教
$ q9 V) r( ^/ t( a8 |1 ^+ |. C8 D

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这个我也搞不懂,呵呵...我现在是用9.3版本.  发表于 2011-7-11 12:06

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发表于 2011-7-8 13:35 | 只看该作者
回复 talonzhang 的帖子
( \2 h" Z" a3 g" J" E+ _9 C, t! X- T6 O/ g4 U. o
多谢JIMMY,我也是这样认为, 只是有个前辈认为也要覆铜,让我好困惑。现在确认不用再覆铜。
5 J0 }9 V# d3 x9 `' m3 M& {0 W) R# ^再请教一个问题,分割电源后为什么选择PLANE CONNECT, 不显示HATCH, 不分割电源(即单个电源时,显示HATCH)。. ]. R2 m# t: O$ o  Y  f! v  i

/ `$ J& g9 @' C+ N. k0 I

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因为你的层属性是split/mix.  发表于 2011-7-11 12:06

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发表于 2011-7-8 14:44 | 只看该作者
回复 talonzhang 的帖子3 f* O! v, o2 l# g, g
' S6 ]1 g7 K* O# ]: ?- b. [, ]- G6 r
找到答案,可能是网络没有过孔接POWER PLANE

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发表于 2011-7-10 15:21 | 只看该作者
pads2007走线没有PADS2005方便,PADS2005走线比较快,顺手。是否设置有问题,楼主能回答一下吗?

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熟悉任何一个新事物,都是需要时间去适应的.  发表于 2011-7-11 12:07

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发表于 2011-7-12 09:56 | 只看该作者
想请教JIMMY,BGA布局、走线的思路,FANOUT出现错误C:\Documents and Settings\Administrator\桌面,有时间帮我讲解一下。谢谢!

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BGA的布局,布线,fanout在论坛里均有教程.  发表于 2011-7-13 09:12

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发表于 2011-7-13 12:33 | 只看该作者
jimmy:. }: K! v! P! \* O: v+ r! v
您好!$ y# @/ g& X$ m# T* {; z  d
请您抽时间做个盲埋孔宏录制的视频教程吧,很需要,谢谢2 V$ K9 s! e5 }2 {. j% a

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https://www.eda365.com/thread-46620-1-2.html  发表于 2011-7-13 12:56

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发表于 2011-7-13 13:32 | 只看该作者
本帖最后由 jimmy 于 2011-7-14 15:36 编辑 / F* \8 B3 ~5 m( y6 `6 l# B

7 y8 L- E4 B, c$ J( A0 Ajimmy:1 n7 d8 r' D9 e
您好!+ q/ n, A/ Z# Y; T: B/ T
您给的链接里只有6层板的宏,我是个8层板,过孔和您的不一样如:L1-2,L2-3,L3-6,L6-7,L7-8, 不知道怎样做宏,谢谢
& u' }- s; f/ C$ C  k
7 D7 D3 I' [3 g+ O" [% @/ x/ }! @
9 |+ k! z& p1 U: Vjimmy回复:) J! [- W9 Q1 e. t. u

8 y  _1 p$ y7 U
7 P! }0 F1 J- u9 o 8L.rar (972 Bytes, 下载次数: 47) 4 c. p0 U5 P* z3 z* O1 G9 m
% r0 m0 ?" y; O' U/ c. r
8层板的宏1 }# u- I' k6 P

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发表于 2011-7-14 14:43 | 只看该作者
本帖最后由 happymewnana 于 2011-7-14 14:44 编辑
* p* q; i) L4 l" ?  o, u9 z" B
) P$ y% Q3 u7 j  Q: T4 z& j. Jjimmy,你好,我想请教一个问题,我在pads logic原理图里改了元件的封装想要同步更新到LAYOUT里,使用ECO TO PCB功能时,会出现“ECOGen failed”的提示,还有一个ECO comparison errors file -- C:\PADS Projects\Logic.log 的文件,
1 f. {  s) @6 ~. ]7 Z1 [% M5 t$ x& K# ^文件内容如下:
2 r2 ~- B* S6 ]) m6 VPADS Layout ECO Generator (Version 6.4v) 2011-7-14 14:40:15
* f5 h0 Q% T4 F5 ^1 }  @$ k7 {8 n( yCopyright (c) 2003 - 2008 Mentor Graphics Corp. - All rights reserved
+ O; w0 d0 Y% p; Y/ XCommand line arguments:  -e C:\PADS Projects\Logic.log -r p -a PART,NET -f -l PCB,NETCLASS,NET4 Q0 ~1 o2 X% n* j2 [
ERROR: Wrong gate pin data at the line: USB-PORT SIP-4P UND  1   0   0     0 Y2 @3 O& s; r9 [5 O0 ?# F) i
ASCII reading (part types and decals) - 0 msec: p. y4 t( s; w/ a/ m3 \+ N
我想知道这是怎么回事,希望大师指点一下!谢啦!

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确认以下几点:1,是否只打开一份PCB文件?2,更改的PCB封装的管脚数量是否与原理图一致 最好有相关的原理图,PCB和库提供.  发表于 2011-7-14 15:38

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发表于 2011-7-14 16:34 | 只看该作者
本帖最后由 happymewnana 于 2011-7-15 10:09 编辑
. _1 O! ]/ J7 E. i5 @; _$ q8 o$ P) ?1 }: }
我只打开一份layout文件呀,pcb的封装是由库提供的,原理图里的示意图是我自己画的,管脚数量也是一样的呀!
3 Y4 \- h" t/ I. o$ S9 Y5 P& t. m
9 y* R) Y9 ~. j
! v( m7 Y6 v! Z& F, H0 e
这就是原理图和pcb,还有库,麻烦帮我看一下,谢啦! mypcb.zip (1.46 MB, 下载次数: 27)
8 Q/ r. e5 k# h" n3 I; P+ s

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最好有相关的原理图,PCB和库发上来. Wrong gate pin data at the line:USB-PORT SIO-4P 说明问题出在此器件上.  发表于 2011-7-15 08:29

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发表于 2011-7-15 10:11 | 只看该作者
这里就是原理图和pcb,还有库,麻烦帮我看一下,谢啦! mypcb.zip (1.46 MB, 下载次数: 21)

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发表于 2011-7-15 11:19 | 只看该作者
回复 jimmy 的帖子
- p  M: B/ `3 i/ ^5 V4 q. e+ ~5 i# _. R! h+ w5 v/ R- z: W
这个群是假的,我加了可是那个Q的主人跟我说他不懂什么PCB

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发表于 2011-7-15 11:42 | 只看该作者
为什么有时候需要制作多层板?每层信号的主流走向是如何规定的?他的信号走向意义是什么?如何指定电源层?如何在分割层上约束分布网络?

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发表于 2011-7-15 13:19 | 只看该作者
PCB板上放置文字标记,应当放在哪一层?

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丝印层.  发表于 2011-7-18 12:35
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