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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2011-6-27 17:46 | 只看该作者
回复 如风 的帖子
# Y: Q- m* |/ Z. g8 T) j* B4 z# F4 r1 N+ c6 _. D( _' S
呵呵我也是被逼得没办法了,电子工程师老是改这改那,没办法, 有时赶时间就手工联线,发了板再改原理图,唉

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发表于 2011-6-28 09:24 | 只看该作者
谢谢,可以了,两层也行,层属性设置好久可以了7 o1 Z) B* Q  Q+ B+ l* K
& B& Z! t6 Z# i( y& D5 Y

( p, g$ x6 T  _! n- I) g                                                                                                                                                                                                                                                                                                                                                                                                                                                                                          

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发表于 2011-6-28 10:08 | 只看该作者
好像俩曾值与用si 计算的值不对应

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是的.还要更改介质厚度  发表于 2011-6-30 16:05
头像被屏蔽

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发表于 2011-6-28 15:34 | 只看该作者
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发表于 2011-6-30 10:52 | 只看该作者
回复 jimmy 的帖子/ ?, ?' Y6 J/ c) B

* q* ~( |6 Y" d1 s: _* \你好,我画的图出现这样的问题,怎么解决呢?https://www.eda365.com/thread-13627-1-1.html4 ^( U& q9 U  Y7 ?, @' I  |" |; G
2 B; w* S( U( G' j; e
类似问题https://www.eda365.com/forum.php?mod=viewthread&tid=31122&extra=#pid454087
3 C5 L  f$ R. J6 z# i+ t8 w求解
1 `% \: p7 E9 u" M& Z- [. z

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贴子里面已有答案.  发表于 2011-6-30 16:06

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发表于 2011-7-2 12:44 | 只看该作者
请问下楼主,我在别人PCB上保存下的decals建起老是出错,我想知道这其中的差别是?

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别人PCB的层数是不是被max layer了?  发表于 2011-7-4 11:59

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发表于 2011-7-4 21:25 | 只看该作者
挖坟啦,挖坟啦! 28326856这个群貌似已经不允许加入。
2 x7 Z; B* t. s1 Q% G8 E, b& E  Q+ v% i3 N+ s0 c$ E2 X# s
加不了!!

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发表于 2011-7-4 21:28 | 只看该作者
PCB中,默认规则中,设为6MIL。由于有个芯片引脚间间距比较密(小于6MIL),如果采用默认的设计规则,DRC时,会显示报错。因而采用规则优先级,在COMPONENT中,对此元器件单独设置,间距设为5MIL8 w$ v1 \5 x+ {1 y! ]9 K  Z
    但再进行DRC时还会报错。不知道是什么原因?    注:此DRC虽然不影响最终的PCB生产,自己明白是由于引脚太密造成了,但这个问题不解决心里总不爽& W8 C7 y. a: |. W9 G6 n
   还请JIMMY指点下

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我是用6mil检查一次后,发现只有芯片这里报错.我会将规改成5mil再检查一次...如果没有问题就OK了  发表于 2011-7-5 09:58

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发表于 2011-7-6 10:21 | 只看该作者
本帖最后由 jimmy 于 2011-7-6 12:55 编辑
8 |( A+ R6 X# L( d7 o; d' ]' r  x9 K9 ^& }
请教JIMMY,PADS ROUTE的用法,在PADS ROUTE里布线的话LAYOUT里没有同步啊.这是什么原因?8 T8 Y8 t, ^4 T% L

) D  R) T8 f, v0 k5 `. j. f$ t0 m

3 F: c- ?- ?* r9 n9 O) w. Q  }4 _# |jimmy回复:
$ B' ^# s( Y8 B7 r
' [( o# m; @& K+ U
# l  ?3 d* K) h2 f' r2 j
) k9 {7 ~) e4 O: e

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发表于 2011-7-6 10:27 | 只看该作者
还有就是ROUTE里加过孔怎么加啊

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shift+左键  发表于 2011-7-6 12:55

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发表于 2011-7-6 17:13 | 只看该作者
本帖最后由 jimmy 于 2011-7-8 11:02 编辑 * [1 O/ F: [% m1 c
1 _! x' J5 }; [- O* v; A
请教,如何把在布线的时候切换过孔,VIA我设置了有两种,但布线的时候一直是一种,不会切换,如何切换呢???
# Y' M% E* W0 f9 X: X
1 W+ s9 \8 u1 v' G; s( _; C% X9 \1 I' O* Y" {; F8 Z
jimmy回复:
1 w) q0 ]1 d  p( l
; t0 g6 a0 p% l" x: I/ m4 n$ m键入无模命令VT,回车后,就可以进行选择了.
& k& {1 c" ^$ x# Y! m- _% C3 P4 N4 P- I( d# {

* f. F) s% W; w, |/ I

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发表于 2011-7-7 08:59 | 只看该作者
请教JIMMY,PADS里要画多张原理图,有没有主次规定呢?就直接添加页,导出就可以吗??

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通过页间连接符off-page就可以了  发表于 2011-7-8 11:03

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发表于 2011-7-7 11:51 | 只看该作者
请问:$ |7 }2 W! g) |* ^, h9 [
pads2007在手动布线时,怎么看不到当前线的宽带?请高手指教!
% `) t1 q* i# F  v) W- e

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设好相关的规则就可以了,如default,class或net规则  发表于 2011-7-8 11:04

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发表于 2011-7-7 16:21 | 只看该作者
jimmy 好厉害

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发表于 2011-7-7 17:53 | 只看该作者
回复 jimmy 的帖子
3 _- F0 C0 v1 O$ ^$ D' N( z
8 z4 A2 J: [! q3 b请教LZ:
9 ]+ z% m- W& z' }
我的电脑里安装了PADS9.0精简版(原来有安装过PADS2005,后来不行了重装也不行,没办法只好装了PADS9.0精简版),将LAYOUT好的PCB导出POWER PCB5.0.asc文件,再用另外台电脑PADS2005导入刚才“导出POWER PCB5.0.asc文件”,却出现以下“警告和ascii.err”问题(见附件),但用另台也装了PADS9.0精简版导入却没有问题;
还有原来用PADS2005LAYOUT好的PCBPADS9.0精简版打开后,再导出POWER PCB5.0.asc文件,用另外台电脑装PADS2005导入却没有问题。不知是什么原因,烦请楼主请教 ,谢谢!

: J1 F# N( u, `; U8 Y, A

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我有点被你绕晕了,哈哈. 9.0打开或导入后会修正原来设计上的一些不符合"规范"的东西. 你最后面的导的asc应该不是之前说的第一份asc吧?  发表于 2011-7-8 11:07
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