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楼主: superlish
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请教个关于晶振的问题

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EDA365特邀版主

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发表于 2008-1-3 08:51 | 只看该作者
标贴晶振满足不在晶振下走线,且晶振尽量靠近IC pin就足够了

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发表于 2008-1-3 11:02 | 只看该作者
我也来凑热闹,呵呵!
# B* h; a' e" C3 D( Y个人认为所有的晶振最好都不要在下面走线,但是如果有地平面或者电源平面相隔后的其他走线层面可以正常走线的。; T3 ?- i( W; Y" ^4 |" N: I
还有一个是晶振背面贴器件的问题,个人认为:表贴的晶振无所谓,但是不能是插件的器件,而插件的晶振是不能这样做的,这个是考虑到工艺的流程问题,单板上如果有插装的器件,如果比较节约成本和常用的贴片方式是波峰悍,这种工艺路线要求BOTTOM面的表贴器件距离插件的PIN最少为4毫米,也就是120MIL。

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发表于 2008-1-3 11:04 | 只看该作者
忘记一点就是晶振下面不要打孔,特别是其他的网络过孔。

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发表于 2008-1-4 09:33 | 只看该作者
以前做了好多笔记本的主板,用的都是贴片的,当时是器件下面前部是地,6层板就6层都是地,包括电源层,那个都单独给挖快地,背面当热也不会放器件。
- o3 q  w# e) @' ?后来有做了一些手机板,上面的晶振下PIN点下面不走线就可以,铺上地,再隔层的就什么线都可以走了。晶振地PIN下面可以走线。
. V! V3 O1 }9 v$ y1 D为什么笔记本和手机的要求不一样就不知道了,难道是每个公司的要求不一样。

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发表于 2008-1-5 10:43 | 只看该作者
应该说是每个公司的做法不一样,一般都要求不可以走线,包地就要看具体情况了,有的包有的不包.. ..

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