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Allegro16.6铺铜问题请教

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发表于 2018-4-12 09:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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今天发现一个问题,在同样的铺铜规则线,实际铺铜的效果不一样。! x5 ~+ {2 D4 W! q
如图:2对差分via,铺铜后出现了不一样的结果,而且DRC是不报错的。现在的处理方式就是把这种铺铜有问题的via删除,重新加via。; V( s/ G% t2 H  _) Y; w7 v
有哪位大神遇到过的,帮忙解答下。
- [; }- g1 ]3 M9 v; ?% q' R4 I0 K  }谢谢啦!!!
: e6 g: n5 W5 S

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2018-04-12_094416.jpg
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发表于 2018-4-12 11:09 | 只看该作者
孔上有其他属性吧,点开看看,可以把孔做批量替换。

点评

仔细看过了 属性上与其他的孔没有任何区别。 整个板子大概有30多个是这种情况。第一版设计的时候是正常,这次是改版,这个位置未做任何改动。  详情 回复 发表于 2018-4-12 11:27

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发表于 2018-4-12 11:12 | 只看该作者
楼上说的对

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 楼主| 发表于 2018-4-12 11:27 | 只看该作者
wshna0221 发表于 2018-4-12 11:09
: a6 ?! D& r! a. o3 `! t# i' }孔上有其他属性吧,点开看看,可以把孔做批量替换。

# Y. v  s# F* l1 B仔细看过了 属性上与其他的孔没有任何区别。$ I; q- m3 r& W8 I$ p* X( ~& X
整个板子大概有30多个是这种情况。第一版设计的时候是正常,这次是改版,这个位置未做任何改动。
2 U- R% C9 z7 c$ E0 ~6 P' m0 t

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发表于 2018-4-12 12:15 | 只看该作者
设置shape到via的距离。

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发表于 2018-4-12 14:10 | 只看该作者
bug
设计生产印制线路板(PCB)、柔性线路板(FPC)、软硬结
合板(FPCB)等;

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发表于 2018-4-13 14:04 | 只看该作者
学习了

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发表于 2018-4-17 09:50 | 只看该作者
正片吧,查下规则设置,同网络也看下。
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