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请教个关于晶振的问题

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发表于 2007-11-29 11:35 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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对于不同的晶振 插件的 或者贴片的 等等  有哪些需要包地处理 ?那些是不能在其表面下走线的? 哪些是都不能走线的?  : @1 }' f; u# K' g, H2 }: j
对于晶振的背面 能不能放置电容电阻之类的小器件??
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发表于 2008-1-5 10:43 | 只看该作者
应该说是每个公司的做法不一样,一般都要求不可以走线,包地就要看具体情况了,有的包有的不包.. ..

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发表于 2008-1-4 09:33 | 只看该作者
以前做了好多笔记本的主板,用的都是贴片的,当时是器件下面前部是地,6层板就6层都是地,包括电源层,那个都单独给挖快地,背面当热也不会放器件。7 F' E/ L. c$ t% g; x$ [  ^
后来有做了一些手机板,上面的晶振下PIN点下面不走线就可以,铺上地,再隔层的就什么线都可以走了。晶振地PIN下面可以走线。
  I4 v9 G. d) C4 `为什么笔记本和手机的要求不一样就不知道了,难道是每个公司的要求不一样。

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发表于 2008-1-3 11:04 | 只看该作者
忘记一点就是晶振下面不要打孔,特别是其他的网络过孔。

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发表于 2008-1-3 11:02 | 只看该作者
我也来凑热闹,呵呵!
3 v8 F( Z: f( u个人认为所有的晶振最好都不要在下面走线,但是如果有地平面或者电源平面相隔后的其他走线层面可以正常走线的。
: Y( |% @( [( G还有一个是晶振背面贴器件的问题,个人认为:表贴的晶振无所谓,但是不能是插件的器件,而插件的晶振是不能这样做的,这个是考虑到工艺的流程问题,单板上如果有插装的器件,如果比较节约成本和常用的贴片方式是波峰悍,这种工艺路线要求BOTTOM面的表贴器件距离插件的PIN最少为4毫米,也就是120MIL。

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发表于 2008-1-3 08:51 | 只看该作者
标贴晶振满足不在晶振下走线,且晶振尽量靠近IC pin就足够了

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发表于 2007-12-13 14:11 | 只看该作者
谢了
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发表于 2007-12-13 14:04 | 只看该作者
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发表于 2007-12-13 13:14 | 只看该作者
如果层叠不一样   也就是说器件放顶层   第二层是电源    那么需要在贴片晶振下电源处挖出快做地的吗? 或者说是不是平面本身就起一个屏蔽作用 无论她是作为地或者电源 只要不跨区就OK了??
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
日飘渺 夜惆怅 醉眼朦胧 真心人赢得天下输了她
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发表于 2007-12-13 08:55 | 只看该作者
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发表于 2007-12-12 14:14 | 只看该作者
学习了

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发表于 2007-12-12 13:41 | 只看该作者
大家能不能讨论一下,贴片的为什么不用包地,直插的就要包地。

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 楼主| 发表于 2007-12-3 09:11 | 只看该作者
原帖由 allen 于 2007-12-3 08:37 发表
% K% t- p1 }4 B5 ~2 P贴片的晶振可以不包地,插件的最好包一下。
$ n8 J8 t6 j0 q4 R/ }9 h
+ g' I9 V& N' \
晓得啦
Allen 该用户已被删除
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发表于 2007-12-3 08:37 | 只看该作者
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 楼主| 发表于 2007-11-30 18:11 | 只看该作者
原帖由 protel 于 2007-11-29 22:10 发表 ! f' a9 y& V/ G" L4 g3 s) {! K

3 }7 D2 V$ y1 l, k, ^: p+ K9 S0 f# j2 e5 p! q# }
板子看过不少,还真没注意到这个问题.,要开始留意别人画出来的板子了.也是一种学习.

4 F2 F: _! ?  I- ~! w( `4 f, N' @* m4 S0 \8 W8 M/ u9 D
呵呵  我也是这么认为的  + Q+ N/ T4 K1 [( w
6 V; {, r# j# D  E; X* I: S- F4 I: W
当各种意见不一致的时候 自己也不会 这时如果有一块板已经作出来成品的而且是通过了的
4 a9 ^. I* X8 L6 Y, e这时把它为参考 对照各种意见  自己也能有一定的选择
zqy610710 该用户已被删除
5#
发表于 2007-11-30 09:56 | 只看该作者
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