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[Ansys仿真] 找不到IBIS中对应的PIN model

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发表于 2012-2-25 22:47 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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在导入xilinx V5 芯片的IBIS文件时,在pin import中找不到想要的模型,电路是这样的:在FPGA端接受来自MPC8536发送的一对PXIE的差分信号(PXIe_TX0_P,PXIe_TX0_N),我把工程文件中的SNP和IBS传上来,大虾们指点一下!

工程文件.rar

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发表于 2012-2-26 22:15 | 只看该作者
reddevils1986 发表于 2012-2-26 21:17 : N/ A! g9 Z9 o7 U3 r$ V) n
用buffer试了一下,仿真可以通过,确实是pin有问题,奇怪了,文件可是从它的官网下的
; i" o& E; i' |+ o5 g) x, h; u% I
应该是管脚和它对应的PKG没联系起来,看到IBIS内容时我就觉得有点奇怪。还有记得用BUFFER时记得后面要加上RLC电路,不然就没有PKG效应了。官网上的文件也说不清楚,很多时候需要自己重新修改,再加上每个仿真软件有自己的调用法式,在一个软件能用到另外一个说不定就趴窝了
; |* t' y. G7 c  h! t. J) Z

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 楼主| 发表于 2012-2-26 21:17 | 只看该作者
yuxuan51 发表于 2012-2-26 20:16 0 _: {# {  w0 e" `; _. I9 A9 m
我把IBIS文件稍微修改了下,你再试试,另外要是在designer里调用IBIS时要是选择调用PIN还不行的话,试下调 ...
; t% `. J. K* G% j; }: r
用buffer试了一下,仿真可以通过,确实是pin有问题,奇怪了,文件可是从它的官网下的

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 楼主| 发表于 2012-2-26 20:41 | 只看该作者
yuxuan51 发表于 2012-2-26 20:16
' L, l7 x  T# S) ~+ U我把IBIS文件稍微修改了下,你再试试,另外要是在designer里调用IBIS时要是选择调用PIN还不行的话,试下调 ...
7 f& w( @+ Q, h
嗯,好的

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发表于 2012-2-26 20:16 | 只看该作者
reddevils1986 发表于 2012-2-26 20:09
9 X* @1 U2 A3 ^6 g! @路径应该没问题啊,都是英文的,谢谢了,斑竹!!!
4 h8 r" k4 f: ~4 B( f% D& k
我把IBIS文件稍微修改了下,你再试试,另外要是在designer里调用IBIS时要是选择调用PIN还不行的话,试下调用BUFFER,就是你贴的那张图前面那个标签,然后自己加RLC电路,你先两种都试试,我总觉得它这个PKG定义有点问题,和管脚联系不上
8 O& f! Z7 g- Q. I3 W# t" x* A2 l4 C; D" }. n8 b! G

3 e* t# D6 f( ^( E0 M5 _ virtex5.rar (480.54 KB, 下载次数: 21)

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 楼主| 发表于 2012-2-26 20:09 | 只看该作者
yuxuan51 发表于 2012-2-26 19:35
% N: t9 o6 w& ?9 C; I; z- O第一个和第二个错误应该是你的工程路径有中文,都要换成英文。第3个错误是IBIS模型问题,语法错误,在那 ...
9 K* a8 B) l+ g$ S* Q
路径应该没问题啊,都是英文的,谢谢了,斑竹!!!

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发表于 2012-2-26 19:35 | 只看该作者
reddevils1986 发表于 2012-2-26 13:22
+ o6 c' G9 [8 ~. J0 a1 B6 F3 o在运行仿真的时候就报出了3个错误,眼图都出不来,我把三个错误发上来,大虾看一下是什么原因
3 J5 K$ {$ j6 _* h
4 u( `% `5 i6 o
第一个和第二个错误应该是你的工程路径有中文,都要换成英文。第3个错误是IBIS模型问题,语法错误,在那一行字符多余80个,修改下应该OK了,明天上班帮你看看

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 楼主| 发表于 2012-2-26 13:22 | 只看该作者
yuxuan51 发表于 2012-2-26 13:13 # _6 x: J/ c$ Q2 T' L# ^/ o7 \! e0 Y
FPGA的IBIS模型不是本来就不对应管脚么,FPGA不像普通的ASIC芯片,它可以自己指定管脚类型
- h) N9 z- `6 C+ V9 R& s% H+ J2 s  `
0 P0 T9 i( j* g/ k% W" o: J7 Z另外你说的 ...
, @% N/ x! W. ]" p* G
在运行仿真的时候就报出了3个错误,眼图都出不来,我把三个错误发上来,大虾看一下是什么原因

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发表于 2012-2-26 13:13 | 只看该作者
reddevils1986 发表于 2012-2-26 10:17
- ~+ v, g/ u+ C+ U如两个图所示,在导入IBS文件后,选择pin import,出现引脚对应的model,发现文件里的引脚编号和实际的FP ...
, X4 N4 ]) @0 H
FPGA的IBIS模型不是本来就不对应管脚么,FPGA不像普通的ASIC芯片,它可以自己指定管脚类型0 g* X1 N' o  R: L/ j+ Z2 u7 X: g

4 [0 x1 B; W# z, ]+ E另外你说的通不过指什么通不过呢,眼图眼宽?眼高?还是什么,最好能详细说下SPEC和你仿真得到的结果

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 楼主| 发表于 2012-2-26 10:17 | 只看该作者
本帖最后由 reddevils1986 于 2012-2-26 10:19 编辑
: r" K5 x% U! A6 L1 r: W
yuxuan51 发表于 2012-2-25 23:45
8 Q  j$ C& Z! t+ ~8 u找不到对应的PIN model什么意思,你把问题描述清楚一些,不然谁也不知道你要找那个model,FPGA里有好多diff ...
8 w7 k1 q6 v# ^6 i
  r3 ?' M& u0 Y2 M' M% P) N
如两个图所示,在导入IBS文件后,选择pin import,出现引脚对应的model,发现文件里的引脚编号和实际的FPGA引脚编号不一样,因为用的是2.5v的LVDS逻辑电平,我就选择了LVDS_25_P和LVDS_25_N这两个model,结果仿真通不过,问题基本就是这样,不知道我说明清楚没有

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发表于 2012-2-25 23:45 | 只看该作者
找不到对应的PIN model什么意思,你把问题描述清楚一些,不然谁也不知道你要找那个model,FPGA里有好多diff管脚,LVDS,LVPECL等等,不知道你要哪个
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