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晶体振荡器电路的设计指南

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发表于 2011-9-29 16:14 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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       最近刚好在学习晶振电路,看了下论坛里面相关的帖子,以及网上的一些介绍。发现一个讲解相对比较全面的设计指南,和大家共享下{:soso_e121:} ,特别是对大家较多疑问的并联电阻、串联电阻以及负载电容等说得很详细。
# n: M5 ~3 v( c0 H9 l4 C! J$ N    另外也有个问题请教下各位。在本设计指南的最后一节,关于PCB的设计里说的第4点(说应该将振荡器的输入与输出隔离开来),我记得刚学LAYOUT时有个前辈跟我讲:振荡器的输入与输出是对“伪差分”,布线时应该像差分线样走线,而实际中我看见一些公司的板子上也是类似于差分走的。现在比较矛盾,到底哪样更好,请教!
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发表于 2013-11-27 14:28 | 只看该作者
二楼正解,晶体的输入与输出肯定不能走成紧耦合的差分线,这样相互间的干扰肯定会增大的!!

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发表于 2013-11-27 14:07 | 只看该作者
感谢楼主,先下载看看

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发表于 2013-11-28 10:46 | 只看该作者
不錯,謝謝分享

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发表于 2013-3-22 13:40 | 只看该作者
正好学习这个电路,谢谢!

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发表于 2012-7-13 00:28 | 只看该作者
晶振焊盘之间为什么不允许走线呢,低速线。

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发表于 2012-3-20 16:14 | 只看该作者
最近正遇此问题,无解。/ b. h/ g) n% f1 {  q

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发表于 2012-3-16 17:56 | 只看该作者
lygo 发表于 2012-3-8 21:11 0 k& A" i0 u+ M$ M" K# z; q9 G
非常感谢
; o$ j. r9 I* ?; G! S
期待牛人回复

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发表于 2012-3-8 21:11 | 只看该作者
非常感谢 6 F8 N( g* l$ l3 ]5 o/ e7 _' P: j) G

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发表于 2012-2-28 11:01 | 只看该作者
谢谢分享

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发表于 2012-2-20 09:53 | 只看该作者
我覺得二樓說的是正解。
7 e; U" b5 ~; ^. ~用檔案第6頁的圖4來說,
! q! o7 o- [! }7 D' S# O, J' y: x想像一個極端情況,若我的輸入和輸出不但不隔離而且距離很近,$ m( X# i1 N" w5 ]' o* f
那意思就是OSC_IN和OSC_OUT兩者線之間會跨一個電容,
4 s  J8 R# c3 ?2 Y2 S! A這時候你用心計較算出來的CL......就都走樣了~
! s) Q" e9 d. y, d0 ]

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发表于 2012-2-14 12:52 | 只看该作者
想不到这里面有这么多好东东,

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发表于 2012-1-12 10:44 | 只看该作者
同样不理解,希望高手解答啊!3Q

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发表于 2011-11-4 21:13 | 只看该作者
感谢!

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发表于 2011-10-28 10:57 | 只看该作者
谢谢分享,好好学习!6 K  E* j; _' T5 k' r7 ]

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发表于 2011-10-27 11:53 | 只看该作者
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