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captuer cis DCR报错,求解.

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    组图打开中,请稍候......
发布时间: 2011-3-31 09:56

正文摘要:

本帖最后由 antoni2011 于 2011-3-31 10:54 编辑 " r7 E/ C/ m, D& L2 j% P! s3 A: c) B ! ?# F4 a" j1 Y$ D2 zChecking Electrical Rules 3 G* y5 x4 ^5 q* K6 T, k& d4 {8 QPossible pin type conflict U1,A ...

回复

ofst 发表于 2011-11-15 12:17
是否只要元器件封装对应时就可以忽略?
antoni2011 发表于 2011-4-3 14:08
问题没解了吗?
antoni2011 发表于 2011-4-2 17:23
此问题没有人进来给指点下吗?
jacklee_47pn 发表于 2011-4-1 10:36
本帖最后由 jacklee_47pn 于 2011-4-1 10:36 编辑 * f3 S- [9 g4 N4 m7 x) y- Q

* Z$ N. ]- Y' J沒遇過這個問題, 上傳文件請大家幫忙吧.
antoni2011 发表于 2011-4-1 09:32
问题已解决.TKS.& G# s# X1 N0 M& p: ]
另一个问题了: 在画地址线的时候,连BUS busentry时,place wire时候,接到IC 一端的时候会有2个重复的junction(点不掉).而且在拉动wire连接时出现惊叹号.IC的pin property跟总线port属性已设置好.
jacklee_47pn 发表于 2011-3-31 20:24
其實這要整體性的考慮, 不是只有單純修改 PORT 就可以解決, 另外也要注意元件的 Pin (properties). 只要一個環節有問題, DRC 都會出現線警告.7 r2 r( x: }# j- l

" h# T! R" K1 t. v/ R9 T通常有許多人, 會將 PORT 或是元件庫裡面所有的 PIN 都設 passitive , 這樣就永遠不會出現這個警告, 但是相對的不會真實的檢查出真正的接錯(例如:兩個PIN都是 input 沒有 output).
& \- ?% [" i8 q7 I1 E
% V3 G/ {- Z3 Q% W& {$ S印象中 OFF-PAGE 沒有 input/output/passsitive 這個的 property 可以選擇.
antoni2011 发表于 2011-3-31 16:57
多谢,jacklee_47pn 的答复!
3 }& }4 P- ]5 {, i3 F6 T( d( z那这样我是否是把总线的 PORT OR OFF-PAGE 设置为 passitive可以避免这个错误吗?& Z& Y+ T% o3 f1 h
jacklee_47pn 发表于 2011-3-31 15:17
補充 DRC Matrix 圖片.

DRC.jpg (99.04 KB, 下载次数: 3)

DRC.jpg
jacklee_47pn 发表于 2011-3-31 15:15
應該說是你建立元件庫的 PIN 的屬性, 有依照Datasheet所說的去設定雙向輸出 (尤其是MCU) , 當雙向的 PIN 接到一個只有輸出PIN (例如 GIPO PIN 接到一個輸出PIN ), OrCAD DRC 會顯示警告.+ S1 ]- W: F5 O
3 ?+ \- @8 n. v( g0 D
這警告其實可以在 DRC 裡面 ERC matrix 去設定忽略(不要W 和 E), 要不然就忽略不管這個警告.
antoni2011 发表于 2011-3-31 11:02
没人知道吗?在线等..TKS
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