正在画一板子先发个局部图，大家给点意见

IO357 · 发表于 2009-9-17 14:08

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我参照了一个图，画的还不错，也是局部的
pci总线

可我一画惭愧啊
大家给点修改意见

平淡 · 发表于 2011-12-23 16:02

真像方便面呀

yh521py · 发表于 2009-11-12 16:11

这是ddr部分吗？走数据线与地址线间应拉开间距，而且数据线组与组之间间距也要稍微大点．
饶等长时相邻层最好垂直走线，不要重叠在一起了．

IO357 · 发表于 2009-9-18 21:53

我用Altium 6.8出的

John-L · 发表于 2009-9-18 15:52

为了时序是要做蛇形线的。
LZ你的3D图是拿什么出的？

IO357 · 发表于 2009-9-17 20:09

下午的进展

3D图

修改后
为了调等长走蛇形线
此种走法对信号是有利还是有害？

cathyyuan · 发表于 2009-9-17 15:08

过孔打得很漂亮

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