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DRC时出现以下错误

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发表于 2008-3-2 11:10 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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Checking for Invalid References
6 n! N- M; w* m/ s1 g# d2 }ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (4.00, 2.10) / }, v" }: P' N& |" U: j5 ~
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (9.70, 2.00) 3 {) |0 _* X0 `) r5 B/ w
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK3 AND BANK4  (9.80, 2.10)
  ]' d4 h! Y! p5 z: mERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK3 AND BANK4  (4.40, 2.10) 8 [; A- k" `$ }8 H
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK5 AND BANK6  (2.60, 2.30)
. `! D/ G8 b  q1 ]' c" ]ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK5 AND BANK6  (8.00, 2.30) $ o$ `2 X) _) C7 F5 h6 _" _! H
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 POWER AND CONFIG  (2.30, 1.40) 1 s' I3 |1 h; z
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 POWER AND CONFIG  (4.40, 6.40)
' h" \: G# n5 G我调用元件的时候操作方法一样,但只有BANK7 AND BANK8 没有报错,其余几个都报错了.1 x* s! N; J' k! E2 K
还有就是我在多页原理图中使用分层端口符号,结果报错:
, f) G5 t1 ]5 g7 ^9 h! Q* N  uERROR [DRC0003]   Port has a type which is inconsistent with other ports on the net DRAM_CKE:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (2.70, 4.80) ( B  w% V1 I3 G4 u: Y
我是在一个电路图上设置端口为output,另一个图上则为input,结果就产生上面的错误,改成一致的就没问题了,但我不明白的是,从原理上说不是一个input,一个output才连接正常吗?为什么都是input或output才可以?我看网上下载的原理图也是一个input,一个output?
" u- s& j( i2 F- Y; }不知道怎么办了$ _3 t: ]4 U" V2 W" W0 Q. U
请教大家怎么修改啊.谢谢了
0 _! ^" a& D- ~- C! _6 H* i2 R6 W9 S/ R( _) C9 l% T
[ 本帖最后由 elmma 于 2008-3-2 13:36 编辑 ]
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发表于 2008-9-1 17:31 | 只看该作者

numbdemon版主请不吝赐教。

我用capture cis 画的层次式原理图,结果也出现了上面的问题,可是我没有把元件分成多个部分,不存在调用的问题呀。请您帮我看看到底是怎么回事呀?这个图的DRC这么我好几天了。
( e% {: `2 d& ]& R0 t您有邮箱吗?我把设计发给您。多谢了。
Allen 该用户已被删除
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发表于 2008-3-3 15:30 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

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 楼主| 发表于 2008-3-3 15:28 | 只看该作者
我之前也是一样调用的,奇怪啊.现在我重新画了一遍后就好了./ V0 u' D( ?" M) \% `! B. h" `- ?
谢谢版主,原来看那个就知道是不是用的同一个元件.晕.我都不知道.

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发表于 2008-3-3 13:00 | 只看该作者
原理图问题比较多,这里只回答有关DRC错误的原因& Q7 d: o2 U9 }
你自己把所有U2的part都看一下, 原理图中U2各个部分调用的source package不一样,有的是"EP2C20_31"有的是"EP2C20_29"等等,也就是说根本就不是同一个元件。再画一遍吧8 A! T; e# ^5 n# e; c5 w9 e
$ m5 O6 F, C) C& Z# {' s
另一个问题是关于Port, 请牢记:
: z9 t4 K& P. |+ M; Xport只针对层次式原理图才有意义,在平坦式原理图中出现port虽然不影响电气连接(事实上也没有错),但是DRC肯定有问题。像你说的两端口都改成input才能避免DRC标记,但是理论上又说不过去。# l! Z* E( `$ t/ _3 v* H" d0 W7 Y
建议平坦式电路图都使用offpage connector作不同页面之间连接,这样才不会DRC出错,input/ouput类型也能匹配
% \" @1 U8 I1 X) D最后一句,尽管你图上port有问题,但是不影响电气连接,也就是不影响网表,不影响layout。所以,就睁一支眼、闭一只眼就当没看到吧
8 M2 r- o; m' Z
" l" I: o# B% c. S' x/ r! s: K[ 本帖最后由 numbdemon 于 2008-3-3 13:43 编辑 ]

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 楼主| 发表于 2008-3-3 10:37 | 只看该作者
知道的麻烦给点意见,折腾好久了,一点头绪都没.
2 I1 `- B5 r& r1 T. b1 ~  g% [6 `' O; X谢谢啦

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 楼主| 发表于 2008-3-2 15:50 | 只看该作者
上传的原理图,.我现在把端口都改成一样的

DE2.rar

607.29 KB, 下载次数: 65, 下载积分: 威望 -5

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发表于 2008-3-2 15:18 | 只看该作者
上传个原理图看一下!
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