Allegro16.6铺铜问题请教

qizhong.lin · 发表于 2018-4-12 09:47

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今天发现一个问题，在同样的铺铜规则线，实际铺铜的效果不一样。
如图：2对差分via，铺铜后出现了不一样的结果，而且DRC是不报错的。现在的处理方式就是把这种铺铜有问题的via删除，重新加via。
有哪位大神遇到过的，帮忙解答下。
谢谢啦！！！

Zhang——XY · 发表于 2018-4-17 09:50

正片吧，查下规则设置，同网络也看下。

zltwin · 发表于 2018-4-13 14:04

学习了

liuping · 发表于 2018-4-12 14:10

Bdv20 · 发表于 2018-4-12 12:15

设置shape到via的距离。

qizhong.lin · 发表于 2018-4-12 11:27

wshna0221 发表于 2018-4-12 11:09
6 Q% P- O9 d0 }1 t' Y, v/ L1 |孔上有其他属性吧，点开看看，可以把孔做批量替换。

仔细看过了属性上与其他的孔没有任何区别。
整个板子大概有30多个是这种情况。第一版设计的时候是正常，这次是改版，这个位置未做任何改动。

丁少_bmPRb · 发表于 2018-4-12 11:12

楼上说的对

wshna0221 · 发表于 2018-4-12 11:09

孔上有其他属性吧，点开看看，可以把孔做批量替换。

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