2017年10月31日QA检查报告节选

EDA365QA

1.CAN是差动信号

: m5 W5 g+ Y, V0 Z% E( ^3 |! H

rock_li29

汤圆LSY 发表于 2017-11-1 16:16
请教个问题，ECL器件互相连接时、信号线是先到端接电阻再到终端器件好，还是先到终端器件再接端接电阻好？
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. }( H! ~7 w. s, n

rock_li29

edapcbsyc 发表于 2017-11-1 22:04
4 G# A% t6 t5 L' j8 p5 T请问差动信号是指？需要怎么处理？

% R) [& K/ W/ u7 k2 U/ Q- M应该是错别字，指的是差分信号，差分信号紧耦合布线，控制阻抗。
  I# J7 b# R6 [% O  a

xynsy123

EDA365QA 发表于 2017-11-1 08:43
8.光口地处理不当

7 B5 l% V( n1 ~. h" [5 c光口金属笼子接GND的话，那打静电的时候岂不是直接打到GND上了？
% W2 H( t: j+ d0 A

EDA365QA

2.周边的铜没有任何连接
3 u$ I5 `! Y5 m( F2 P, X( D6 s

9 i+ a* a, q4 Q$ p* g
% k' I3 Y3 w, \, j

' I4 b" B! X' C4 N. F5 m8 {

EDA365QA

3.尺寸标注有误差
# L  [* R0 u* |  F# Y
, U! \  S# C, g$ J/ _

EDA365QA

4.很多线跨分割了。

  c: Y% h1 D3 N# g

EDA365QA

5.电源瓶颈
) n4 J) z/ J8 y& A3 ^* e* E3 X7 ^

EDA365QA

6.FPGA的100欧姆电阻未按要求等长处理
7 n* G) N1 _/ L1 c% X' n8 T7 u2 @
8 t. z; W  }- Z% u: w

EDA365QA

7.钢网层有多余的文字

2 t) b, c+ J3 `# h

EDA365QA

8.光口地处理不当
! k& A# S- ?4 {6 _
0 @5 T3 K7 f5 i. ]5 B. z

2 d0 L  t2 p3 a) k

EDA365QA

9.加强筋下放了接插件

EDA365QA

10.铜皮未有连接孔
  V# o* Z/ d2 g$ E
7 u% e2 Y& q# _5 L* y* s9 T

EDA365QA

11.平面整层没有铺铜
$ f5 }! n+ F) S) k
) a+ l# h* Y# k2 `

lqf

学习

guhanzuiying

汤圆LSY

请教个问题，ECL器件互相连接时、信号线是先到端接电阻再到终端器件好，还是先到终端器件再接端接电阻好？

汤圆LSY

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