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SystemSI仿真时VTT报错

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发表于 2016-6-18 17:23 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x
请教各位,在仿真ddr时有如图报错: |& H) t& ]5 J! X7 F9 U
有劳各位指点一下!!!" v' t1 X- B* j6 s- X! p- b2 B8 z! S

5 q# Y# _2 R7 E- S* B& h, _*** Messages reported by SPDSIM (build14.0.2.09101) ***
8 [) `9 X- C; h( e+ ~. EWarning 5160: ".ends rpacks  " is not supported in include file, ignored.
2 ^0 I4 L" f% g8 J2 w  Location: statement at line 4
; I# `: U9 s! O1 T! X  Context: .inc 'D:\Cadence-SI\CHP4\T20160612\L1\TEST\DEMO\rpacks.sp'2 i' e9 x+ h$ m" ~6 e
Error 2178: In the value expression: 4 R2 {9 M. T. T2 @
Undefined parameter name "vtt".
; N5 g9 A! b9 y4 o+ D/ n3 L- }& M; T/ d! X8 \7 F: c/ H5 c& o0 A
  Location: statement at line 1970 E- W+ ~; Q4 e/ o  O3 R" y
  Context: .end# I8 R) G' l& X2 g( @# h

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 楼主| 发表于 2016-6-20 10:14 | 只看该作者
怎么无人问津啊
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