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两个工程,各一个原理图一个PCB,如何将两个PCB和合并到一块?

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发表于 2015-9-11 14:06 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式
1E币
本帖最后由 any_014 于 2015-9-12 16:03 编辑 9 ^* t% v- q. e% P( K) d
% O8 A; |9 @2 Y1 z6 D+ A/ N
其中一个是核心板,一个是母板。原来是分开的,通过排针链接。
! z$ O4 o5 B% w7 m  s现在想一个母板中直接嵌入两个核心板,就是都在一个板子上。. m; Q. Y' p4 W: L6 d8 }" C
有什么办法呢?头疼。6 p$ o7 a* A: m+ _% Y4 {2 e
# A& N& p! _4 ?5 N. W
---------------------------------------------------------------------------  `& R/ a, P7 J% _1 ]# d" d, F
  {2 u0 c! D& C5 W1 I
总结一下吧。
8 C+ L& t8 _+ u0 P层次化原理图设计,将核心板原理图repeat两份,后来的这份按照之前画好的执行copy room formats后,可变成排列走线一样(貌似敷铜没有复制成功)。
% j- P1 ]* G6 M6 O% Y原来的原理图是sheet2,对应的pcb图上的两部分网络和元件名都自动加上了_sheet21和_sheet22。
" u/ }. W* ^2 z4 u6 ?' i然后又把母板的原理图和考进工程来,因为之前的元件名和网络名都自动加上了后缀,所以基本上不可能和现在家的母板有重名(电源网络除外)。
+ t3 u# i! `. ^9 i# t把母板pcb再拷贝添加进现有的pcb里来,就可以和原理对应上了。5 P# }7 e8 t: ^- k( v

0 x0 X" J4 |1 K$ Q% e, z最后遇到的问题我另发帖询问吧,这个算是结贴了。4 I+ o. H9 y6 s, T/ Z9 i$ X

最佳答案

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1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号重复,保持网络这两个选项; 2. 普通合并:将原理图都放在同一个项目下,然后要新建一个顶层图,并放置sheet symbol,即使这两个板子上相互独立的,然后按照方法一新建PCB并进行合并; 特别要注意,新建的pcb的环境要跟你已完成的PCB的环境是一样的,比如规则,叠层。 如果层数或者厚度要求不一样,那还是放弃吧。
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发表于 2015-9-14 17:33 | 只看该作者
any_014 发表于 2015-9-12 11:22
: r1 y8 _9 ?9 H: K谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗 ...

$ V+ r) l( W" G+ Z! ~很多飞线是无法避免的,除非你把两个原理图的网络都改成没有重复网络名的,这不现实;
' |' O- N5 ?  |" r, U; D, Z3 Z
+ ~2 l# f/ F- a$ y' N7 y# C一般你在复制之前,可以在各自的PCB检查DRC错,确认无错后在复制。4 i2 U. c5 J, S, o/ Q7 V4 O! k
建议你把复制改为剪切,这样你可以确保是不是所有东西都被你复制了,剪切完源文件不要保存就可以了。6 [1 O- g: k" T) T4 @( ~5 z

5 {; H2 ~+ w4 @敷铜没复制过来这个问题,你试试复制的时候,对于重新铺铜的提示选择“否”: e3 ^, s3 a, f9 F2 V7 I

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发表于 2015-9-14 17:29 | 只看该作者
any_014 发表于 2015-9-11 17:354 ^) M, v: Y& t. b2 R4 p- ]" G- h
另画了个简单的工程测试了下。% u; d6 I# w) r) ]+ w& y, @& x
画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及 ...

$ ^7 ]% `1 |. P* @' K6 n9 q你是不是忘记把新的两个模块的room添加进跟老模块同一个channel class了??添加进去就可以了。
+ Q, V" Y6 k8 ~) Z

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发表于 2015-9-13 21:22 | 只看该作者
合并不是那么好做的,不过也还是有办法的,三言两语说不清楚。

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 楼主| 发表于 2015-9-12 15:07 | 只看该作者
本帖最后由 any_014 于 2015-9-12 15:09 编辑 0 j, r5 f+ j. a4 e
6 j$ A* ~, y, j4 L' m) s" p0 M
请教:sheet2复用了2次,对应的pcb中的电路为sheet21和sheet22,现在想将另一个原理图中的网络9连到sheet21网络里的9,不知道该怎么操作了。请过来人指点。% m1 X, H& _, l
10,11,12这样连过去的话,sheet21和sheet22里的相应管脚都会连过去,不是我想要的。
3 ]3 A* {! q* T$ L( Y6 Y$ s7 L: a3 _5 U& y, b- o& a
9 @* Q; }$ z" D" c, Z

& [) c' w# K8 H! }* X! O; h5 [另:本来想用总线连接的,直接联系啊[1..100]到另一个sheet里的[1..100],结果ad崩溃了。& k6 n  D3 T) l( Q6 J( n7 \

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 楼主| 发表于 2015-9-12 11:22 | 只看该作者
2723498933 发表于 2015-9-12 08:35
( N+ V) H0 ?! z/ D$ y% \9 V% p特殊粘贴!可以实现位号重复!

7 X* a6 H, V7 ]; y0 u谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗?
9 Y6 i/ ^3 t  [9 K7 V( U
) L. F5 W2 |2 ]7 l* x; u今天试了层次化原理图设计,复制成功了,但敷铜没复制过来。7 r! e( A& K* ^7 u

点评

很多飞线是无法避免的,除非你把两个原理图的网络都改成没有重复网络名的,这不现实; 一般你在复制之前,可以在各自的PCB检查DRC错,确认无错后在复制。 建议你把复制改为剪切,这样你可以确保是不是所有东西都  详情 回复 发表于 2015-9-14 17:33

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发表于 2015-9-12 08:35 | 只看该作者
any_014 发表于 2015-9-11 16:22# a* O6 W. S7 O& b4 W
谢谢回复。
4 T! u- v: w8 {. d" u" ^9 k粘贴时允许位号重复,这个选项在哪里找呢?0 t/ S0 R. e. d! Q/ v
或者,粘帖的时候,能否元件标号自动重新分配?

- E2 `1 j7 k4 X( f* ~- ^特殊粘贴!可以实现位号重复!1 ~/ |) [4 `0 P

点评

谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗? 今天试了层次化原理图设计,复制成功了,但敷铜没复制过来。  详情 回复 发表于 2015-9-12 11:22

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 楼主| 发表于 2015-9-11 17:35 | 只看该作者
himonika 发表于 2015-9-11 16:015 x5 |( R% @; K4 o
1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号 ...

. R9 g4 E; X* z3 l' I; d另画了个简单的工程测试了下。8 z+ ]5 K% I: Y: u+ v0 ]! [
画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及相应元件,摆放好一个后,可以copy room formats,另外的room就变成了同样的摆放及连线。5 s4 y/ i8 H; n! u0 T

4 W- U0 H3 Z9 I/ x; m7 S, i但,回到原理图后,改成复用5次,更新PCB后又出了2个ROM及相应元件,但再次copy room formats后,却提示:“the source and destination rooms are members of different channel chasses”
+ ]$ j* ^6 A# l) z0 k  u4 i0 \/ ]/ }8 ^: @

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你是不是忘记把新的两个模块的room添加进跟老模块同一个channel class了??添加进去就可以了。  详情 回复 发表于 2015-9-14 17:29

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 楼主| 发表于 2015-9-11 16:40 | 只看该作者
本帖最后由 any_014 于 2015-9-11 16:43 编辑
9 ?+ t0 Q& R5 [6 V2 _( m
9 ~+ t4 T5 E( M+ X1 u6 A6 B试着放置sheet symbol,然后将其对应原来的原理图sheet2,又设置其属性为repeat(sheet2,1,2)
9 c+ y# \$ `% P/ \8 |) m/ P6 S结果出了两个room,分别为:sheet21和sheet22,但原Pcb上的所有元件都被移除了。
( w9 {, l  m- [  l* `+ l
# u7 }  A9 U! _  ~* j; G4 F/ F9 U' b- `/ d8 K) u2 q5 T, F
我是按附件中的说明操作的。3 d' u5 V2 P2 O
Altium Designer 中原理图及PCB多通道功能设计 by pkkong.pdf (1.51 MB, 下载次数: 48) * R8 P4 s% [) M1 g* [
: I& b( E& x" A3 D7 d& `: p7 G# I

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 楼主| 发表于 2015-9-11 16:22 | 只看该作者
谢谢回复。$ L0 P8 r5 U8 {+ l
粘贴时允许位号重复,这个选项在哪里找呢?: ~4 w* l. V- A; L4 b7 Z$ I
或者,粘帖的时候,能否元件标号自动重新分配?

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特殊粘贴!可以实现位号重复!  详情 回复 发表于 2015-9-12 08:35

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 楼主| 发表于 2015-9-11 14:16 | 只看该作者
最好的办法是两个工程的原理图能对应上,元件编号不冲突,然后把两个PCB复制到一个PCB里,对应两个原理图。

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发表于 2015-9-11 14:06 | 只看该作者
1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号重复,保持网络这两个选项;
6 o* t/ T& f6 l# W- F
: l& h: O5 [# J1 v4 N2. 普通合并:将原理图都放在同一个项目下,然后要新建一个顶层图,并放置sheet symbol,即使这两个板子上相互独立的,然后按照方法一新建PCB并进行合并;
( f, k. @* d9 Q8 y# j8 X1 g7 d) i% n2 t# N0 A5 B
特别要注意,新建的pcb的环境要跟你已完成的PCB的环境是一样的,比如规则,叠层。
: Y9 n7 S% E* x" |3 X6 X
  _2 }: B- ?3 n+ q3 k2 `% u如果层数或者厚度要求不一样,那还是放弃吧。

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另画了个简单的工程测试了下。 画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及相应元件,摆放好一个后,可以copy room formats,另外的room就变成了同样的摆放及连线。 但,回到原理图  详情 回复 发表于 2015-9-11 17:35
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