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请问各位,orcad15.7的原理图问题

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发表于 2010-3-8 15:25 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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orcad15.7 可以像protel那样先画原理图,再从原理图里生成电路块,也就是层电路;这样可以很清晰明了地看出各个模块之间的连接关系了
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发表于 2010-3-27 00:32 | 只看该作者
也就是层次化设计吧。可以的。不过模块不是自动生成的,是自己建的,底层的模块要放置好输入输出端口,在做顶层模块的时候,输入输出端口也是自己放的,不是自己生成的1 X7 i% u- o- b& f! j: i( D
0 ^3 Q- C/ J4 M( E2 a# p) c+ ~
1,点击带有四个菱形的方形,添加上层模块。添加完,如第二副图。4 g% j! |5 y7 W7 w0 `3 p$ M
2,第二附图下面的value 为底层原理图的名字。
$ [% H3 o$ I' p( T; a3,选中模块,点击右边“旁边有H标号的菱形”添加端口。

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发表于 2010-3-27 21:54 | 只看该作者
本帖最后由 angelyy 于 2010-3-27 21:56 编辑 3 [/ ^# |/ _' N2 y* W. I- ?1 x

* W. T( P6 N: y3 v' w
  t$ b6 W$ x+ d1 m7 K# M% Y( m1 @继续。。。。。。。。。。。。。。。。。。。。: W, J; Q  M, r$ j) A# r
设置注意:+ c- c. u- G* t+ t/ v8 ?
右键打开属性后,需要设置的一些。( Q1 e5 W& B' R
1:implementation type 必须选择 schematic view 。: a+ P1 W8 _# m$ D1 v% T; I" {) j( M
2:value 为底层原理图模块的名字。
$ L1 d! @5 h7 i: b* _3 p2 F0 a% s/ d' V( Q3:层次化设计的时候,顶层的图纸排序必须在底层图纸排序的前面。如下图:
* d; g* S" b' V( X# B7 ^, I4 k ' _- v  u- g, y2 q: W
也就是说:只能是02原理图调用01的原理图,01的不能调用02的。; m' H( F! G9 l+ @# j5 r
注意:02的原理图上有一个“/”标志,那个是root原理图的标志,也就是最顶层的原理图(如果是层次化设计)。; I' _% ?1 a1 O' t
如果你想更改01为root原理图,首先保存工程文件,然后点击01,右键“make root" ,这样就可以了。01的就可以调用02的了。。

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发表于 2013-11-16 23:51 | 只看该作者
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