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关于DDR3性的问题

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发表于 2012-12-31 11:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大家好,附件是CPU-DDR3的控制器电路,如图中,
' T2 P7 \1 S4 Q+ `; r% I5 DDDR3_ZG  R3-240R的电阻的作用是强度调节的么,4 Q0 M2 v# S  _) r6 A- u  H; O
DDR3_ODT0作用是什么?
0 z; F0 H) j4 Z( ~9 W, j& s  BDDR3_WEN 作用是什么?
' T9 D+ Z% |! v% R, iDDR3_RASN作用是什么?
8 J0 {6 |# U' s% Q  u3 MDDR3_CASN作用是什么?
' f9 u$ r& d5 k; KDDR3_CKE0 作用是什么?
' ~, O& K) H  o) |0 B9 DDDR3_BA作用是什么?" a+ o, W1 p+ r* `. l
MEM_SREN作用是什么?" W6 U& _  e: E. m

DDR3.png (78.82 KB, 下载次数: 3)

DDR3

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发表于 2012-12-31 13:50 | 只看该作者
DDR哪有太多要设计的    下一份DDR3规范  这些东西都是最基础的 里面都有讲  论坛里面有人上传,自己搜

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发表于 2013-1-1 11:10 | 只看该作者
{:soso_e112:}性的问题???

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 楼主| 发表于 2013-1-4 15:18 | 只看该作者
你有此DDR3规范 么?发给

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发表于 2013-1-6 17:00 | 只看该作者
被性的问题引进来了。。。。。
头像被屏蔽

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发表于 2013-1-8 15:04 | 只看该作者
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