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[仿真讨论] ADS/ANSOFT DESIGNER用verilog-a是否可以建立行为级的激励与仿真？

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mengzhuhao

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发表于 2012-6-13 11:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 mengzhuhao 于 2012-6-19 08:23 编辑
" n# I$ D5 b' J9 X- @
6 U) A- ~; Y, R+ q' y- aADS/ANSOFT DESIGNER用verilog-a是否可以建立行为级的激励与仿真？
" C, I  o5 C2 v5 j& Y
' m, w% H9 o2 B, E: t能实现类似RTL级的逻辑时序仿真么？  H  e2 J- }: e7 {5 c

1 v( i4 c! M7 ^; c9 S有对这块熟悉的朋友么？
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