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Drc Error solder mask to shape spacing解决办法

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发表于 2011-5-30 14:17 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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布完线准备在TOP层铺铜,可是总在VIA处出现DRC错误,不知怎么解决,新手求助?4 ?" C9 a4 f6 e
Drc Error: soldermask to shape spacing。应该是阻焊距离VIA的Shape太近,怎么设置0 c4 d, c1 s# t/ r- h8 P, X
可以消除错误?
5 E& q3 ]# L; B  O; k  |# L8 D) S4 q- [7 V* `
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 楼主| 发表于 2011-5-30 15:34 | 只看该作者
问题太简单了?路过的也指点指点哈

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发表于 2011-11-15 05:04 | 只看该作者
今天,我也遇到这个问题。好像是连接via的线径太宽了。

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发表于 2011-11-15 08:45 | 只看该作者
点击第一个,再点击你刚铺的shape;点击第二个,逐个点击和它冲突的via,试试看。

avoid_shape.jpg (1.51 KB, 下载次数: 43)

avoid_shape.jpg
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