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[仿真讨论] DDR2 VREF 线宽要求

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发表于 2011-11-24 11:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有些资料写的20mil。有的资料写的30mil,还有的写的电流很小,不用太宽,还有的写的不能太宽,容易收到干扰,
# P. A; h' L/ A0 e线宽如果太小,会有什么影响啊,线宽的容限应该是多少啊?
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发表于 2011-11-26 15:36 | 只看该作者
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发表于 2011-11-28 17:12 | 只看该作者
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