求教 Allegro 15.5 网表与PCB 同步Hilight问题

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电梯直达

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发表于 2011-5-19 10:38 | 只看该作者回帖奖励

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请问，用Allegro 15.5 Capture Cis 电路图 Creat netlist 的时候，怎么设置，产生的文件netin到Allegro里面，可以保证同步hilight？

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