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发表于 2011-3-6 21:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我是菜鸟,现在正做一块10G的pcb,用cadence,有些不知道从何下手,想请教
  }" [' ?4 U8 C& Y, R. E& q, r1 在导入网表之前是不是要进行仿真得到布局的约束规则,这个仿真用cadence怎么做。
0 T) x% d2 w+ n5 d7 \7 t2 在布线之前进行仿真得到布线的约束规则,请问怎么做仿真
% \* m' r% O& W  o; W0 c真的很急,请高人指点
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发表于 2011-3-7 08:35 | 只看该作者
高速没做过,无法提供帮助。
! Q6 s+ k% |" g! S0 t. a不过就个人理解:cadence的仿真是板级仿真,就是说规则设置之后布局布线,然后进行仿真。
2 S4 `/ l7 P: \! }5 B7 R请做过高速的朋友们鉴定下。
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