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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教
$ T- w6 _% S  K9 k

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 2)

2018-01-11_17-24-33.jpg
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发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?0 ?. h5 T3 w5 t/ |( z+ P
+ |8 O6 v( u* V% _# e

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没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

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有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
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 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32
/ x" V! I; M- C前面网络那一步没有问题吗?

1 X9 A2 ?/ K8 [没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。
/ [' ~! M1 C4 |" P4 P

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 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58
+ i3 ^- D4 g$ u参考差分的形式,你的模型是不是有问题?定义了差分?
7 V) M: n% F: X* R
有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?
% F# D! i& ]  c2 ~& G

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直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:29
; ~# P  i$ b. z( O- L: t* J) ^有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...
9 X% m: k4 f  u0 {, x: F' m9 |& x
直接打开就可以看啊9 P6 v" Q( h3 R

点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53, m8 x  s6 b% Y, t% x4 Z5 d
直接打开就可以看啊
: h; U, O5 A; n+ |
打开看没问题啊,有什么解决办法没有?
0 T2 n1 B- |8 q$ O

2018-01-15_17-10-47.jpg (321.1 KB, 下载次数: 0)

2018-01-15_17-10-47.jpg

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 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53
8 G* J- X. l" r, S直接打开就可以看啊

! l; T" N) K' D& |+ W$ K4 U2 `! I4 h问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了
9 T; K- J# n/ j
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