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请教关于16.3的区域约束条件

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发表于 2011-3-28 09:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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看了15.5的视频发现有个区域约束规则,正好我布差分线,器件内部有一小段和外部的约束条件不一样,就想着是不是要用到这个区域约束规则,但16.3好像和15.5不一样,我找了半天也不知道怎么设!!!希望高手能给点指导
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发表于 2011-3-28 11:58 | 只看该作者
本帖最后由 XYX365 于 2011-3-28 12:22 编辑
, J5 c" }' U3 G0 W7 [6 \& U' U7 P
buptdlmuzbx 发表于 2011-3-28 09:56
$ l" J2 Q+ |  p看了15.5的视频发现有个区域约束规则,正好我布差分线,器件内部有一小段和外部的约束条件不一样,就想着是 ...
7 E4 O3 _! T5 r& \

! L' P% F) b2 d! F& }/ r, Y* N' h是不是這个' A$ R4 _+ D8 C% L5 S4 n* z4 d
15.5 ---- Board Geometry -> Constraint_Area" I. V1 C: f! c+ U' f1 P: p, g
16.3 ---- Areas -> Constraint Reg... -> Through All
9 \: L% Q# H& K: r

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发表于 2011-3-28 12:06 | 只看该作者
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