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cadence 16.3的一个发现

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发表于 2010-3-4 20:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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其中一个组件,FPGA System Planner没有破解,提示是没哟license可用……
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发表于 2010-3-4 21:27 | 只看该作者
我用不上这功能,没关系

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发表于 2010-3-5 00:16 | 只看该作者
本帖最后由 winricky 于 2010-3-5 00:17 编辑
) M* J1 j" X; k7 b9 L5 M, o6 k! l7 \; O7 ?4 H) A; K
做什么用的?
6 z" }: G+ z* V  u2 ^7 s. g# L& t听说mentor有个工具,可以由FPGA工程师根据程序分配需要的管脚, a3 U; Z# i% M$ R4 p" S' p: s
然后把这个约束反应到layout工具里

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发表于 2010-3-6 00:01 | 只看该作者
修改 Device 文件,也可以实现约束 FPGA 的引脚

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发表于 2010-3-6 00:12 | 只看该作者
本帖最后由 zlei 于 2010-3-6 00:15 编辑 ; ~- n6 V/ C9 f( @; j! H6 T
! L) `8 M% P$ {- L" A5 [
License提示:
6 b( l+ }' _# i3 b4 k7 b) J加入如下lic,然后用pubkey重新生产license即可使用"FPGA System Planner ”
) X5 `+ l. L! Q4 f- h, n* P; \$ X1 R
FEATURE OrCAD_FPGA_System_Planner cdslmd 16.3 permanent 999 SIGN2="1600 0D4A 58BF 87B1 \
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    BC31 6DF0 16D9 A1C6 48A2 757D C723 F93C AC03 0800 FB04 D4C3 \
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& P( Y2 U) U' A. ^( T: u8 }
9 V+ |6 Y$ e: K! J6 W' O* MFEATURE Allegro_FPGA_System_Planner_L cdslmd 16.3 permanent 999 SIGN2="1600 0D4A 58BF 87B1 \" h! U" z  @. H: O& E  [% J
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FEATURE Allegro_FPGA_System_Planner_XL cdslmd 16.3 permanent 999 SIGN2="1600 0D4A 58BF 87B1 \
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    195E C396"

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 楼主| 发表于 2010-3-6 13:24 | 只看该作者
楼上大牛,谢谢呀!
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