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两个问题Gerber、nc drill figure

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发表于 2009-8-17 17:02 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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这几天遇到2个问题:
' ^- c. m% V, t, v4 ]1、我在出gerber文件的时候没什么错误的提示,但是使用cam350 9.5版本查看光绘文件的时候,negative的两个层出来的anti gnd和anti vcc那条分割线怎么没有全部显示出来,如下图所以。正片的话是没有问题的。
5 z# O3 i' t1 @9 e9 g2、在drill legend的时候,有些symbol的through pin怎么不显示drill figure,但是我打开symbol直接将其他的信息都invisible掉,只显示drill figure的时候,有显示啊。思考良久不的其解,哪位大侠指教一下,谢谢!

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发表于 2009-8-18 10:38 | 只看该作者
分割线要在GERBER设置里加上ANTI-ETCH才会显示出来。

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 楼主| 发表于 2009-8-18 17:10 | 只看该作者
楼上的,出gerber文件的时候我已经设了那个anti etch啦。你的非正解啊,期待……, ~/ z! |, V$ b; K- R# n
至于第一个问题,我找到了怎么显示所有的drill figure的办法了,就是在manufacturer下执行NC——Drill customization,里面还可以重新设置,好用的很,效果如图。

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发表于 2009-8-18 17:48 | 只看该作者
由于我们对CAM350使用不熟悉,导入ALLEGRO文件,会遇见不少问题,但是基本都没问题的其实。

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发表于 2009-8-18 23:39 | 只看该作者
负片层按快捷键“N”
2 e- P  u* A% [0 I, W再看看光绘显示

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发表于 2013-10-12 15:55 | 只看该作者
请问楼主,我目前也遇到了您上面提到的问题2,烦请您提示怎样解决,谢谢!问题图片

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发表于 2013-10-12 23:50 | 只看该作者
Gerber 是以 6x00 還是274x 輸出.! \8 v, @/ k, [5 ~2 b9 V. S) F: Y
倘若是 6x00 , 則 Anti-etch 必須加入底片資料中 , 如果是 274x , 則 anti-each 不能加進去.

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发表于 2013-10-13 09:32 | 只看该作者
procomm1722 发表于 2013-10-12 23:50* D' b) `7 T( y7 {# P
Gerber 是以 6x00 還是274x 輸出.
! B, J( g8 [  f倘若是 6x00 , 則 Anti-etch 必須加入底片資料中 , 如果是 274x , 則 an ...

6 ?/ u5 R' [' }能否帮忙解释下问题2,不胜感激!

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发表于 2013-10-13 17:53 | 只看该作者
独自漂流 发表于 2013-10-13 09:324 H- C, o6 u* J! a
能否帮忙解释下问题2,不胜感激!
7 o2 L; Q8 k: X+ o( u
這個問題要看到檔案才能知道問題是在哪裡!' T% B) D' e! F* F
可能的話 , 把 board file 和所產生出來的 Gerber file傳上來看看

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发表于 2013-10-14 08:03 | 只看该作者
procomm1722 发表于 2013-10-13 17:53
/ p* i' `# {8 c+ `0 {  J! g) V* w這個問題要看到檔案才能知道問題是在哪裡!; F# x6 a7 M- ^* M
可能的話 , 把 board file 和所產生出來的 Gerber file傳上來 ...

1 \3 a: T1 X& M7 K" d以下这个链接是之前详细问题描述。麻烦您帮忙看下!{:soso_e100:} https://www.eda365.com/thread-92580-1-1.html

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发表于 2013-10-14 15:44 | 只看该作者
我猜想這個問題有可能是 sub drawing 引起的.
$ M' S* n( d5 T" X: ]你光給個 Via 的資料是無法判定的 , 誰知道出問題的 Via 到底是套上哪一個 Via Padstack , 把 Board file 傳上來吧 !

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发表于 2013-10-15 13:54 | 只看该作者
procomm1722 发表于 2013-10-14 15:442 Q6 F2 k( [  k6 _- e9 h) O5 J
我猜想這個問題有可能是 sub drawing 引起的., R! M7 }5 R3 z  v/ A& M
你光給個 Via 的資料是無法判定的 , 誰知道出問題的 Via 到 ...
: r: Q: @# G4 r# a5 e
麻烦您帮忙查一下,谢谢!

board.rar

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发表于 2013-10-15 22:28 | 只看该作者
確認答案 , 這兩個 Via 並非使用同一個 Padstack . 因此你換看到不同的結果是很合理的.
3 `. J0 V- ]1 s) \, i7 c左邊的是 VIA_C110H60T110_140_40 , 右邊的是 Via , 而你的 Constraint 是指定使用 Via .4 p( a1 P7 a- O2 y

5 v, o' X4 R$ n- l$ b( w0 z5 r因此你的問題應該是貼圖造成的.
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