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发表于 2009-6-11 17:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1.allegro中pcb画完后能不能像PADS一样,有个DRC和连接性检查的统计啊?
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发表于 2009-6-12 11:12 | 只看该作者
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发表于 2009-6-12 14:00 | 只看该作者
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" ]$ s& J' n% I* |  Jymf2529 发表于 2009-6-12 11:12

6 j' ^" s5 V* N这样不直观,这个命令:Setup-Drawing Options,如下图:" d' @2 [" F7 @, P( H

+ m( t, g/ y3 h" e; b8 y第一行是器件的摆放" _3 g) g3 V& i2 H* z0 i5 \6 v9 u& o
第二行是连接性
2 a9 c+ S+ e2 v- T第三行孤立的shape
7 @) x# M  R; ]1 ~第四行没分配net的shape
6 @5 d* L3 q( x第五行是1/21意思是,21块铜,1块没网络.- g) p# T- x; w; T4 B$ \
第6行是DRC错误个数
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