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关于等长线的问题

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发表于 2009-3-9 14:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我的板子有64根数据线+ j  K  M# }6 P- p
在top层不能完全布通 需要把其中一部分布到内层7 i, y9 S# \- C6 b0 L9 n
这样走内层的线每根至少要两个过孔" @# }, t: H4 G+ Y1 N) ^0 b: \5 r
请问这样布等长线的话过孔的长度可以忽略不计吗. @) |3 W6 c8 r* ~3 O! Q
而且内层的信号速度和top层的信号速度不一样
2 x5 R! p, H3 Z% D, x: b那么改如何做到数据线等长呢/ ?4 j8 y; S6 Z( k/ z! d1 u) n

6 S1 R0 Y$ N( |% T& }/ V- D9 n请各位帮个忙指导一下
; q: _( q: R6 I' H% Z: \2 R谢谢了
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林嘉欣,我稀罕你!!

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发表于 2009-3-9 15:10 | 只看该作者
而且内层的信号速度和top层的信号速度不一样
' z4 ~) e* l( H/ l5 K. t0 O那么改如何做到数据线等长呢
" C' j! ~6 |8 W) N) a9 Y————————————————————————6 ]; z( h1 Y6 o' N8 x9 J: G9 S  d
这点我也想知道。8 O) ~# J1 J; m5 K
. l& ]8 P  B" e" u
另外,100Mhz的SDRAM的布线要求应该不是太苛刻吧,只要使SDRAM尽量靠近CPU,时钟线尽量短,布线随便布就可以。跑起来就没问题。(SDRAM是100MHz的情况。)
, q; Z3 a: V1 J+ A7 Q& B过孔应该可以不可虑。但是如果考虑的话,应该如何计算?2 d" o  R* s$ G# y4 ~8 K
同问。

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 楼主| 发表于 2009-3-9 17:20 | 只看该作者
高手来指导下呀
林嘉欣,我稀罕你!!

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发表于 2009-4-12 09:07 | 只看该作者
过孔对上升时间的影响,差不多也就十几二十皮秒,对于这个速度的可以不考虑了。对阻抗倒是影响大些

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发表于 2009-4-15 17:42 | 只看该作者
???????

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发表于 2009-4-26 01:14 | 只看该作者
一般情况下,一个过孔等于2~3MM的长度。SDRAM,DDRI,LAYOUT时可以不考虑。* Q8 }7 A+ U2 n1 q) K7 B
但DDRII,DDRIII需要考虑。
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