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Net wire has multiple net name

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发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误+ _& w, N* N1 {# K/ G/ I1 f
Net wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_Interface SRAM_A0(passive))5 ]" B% L1 P3 Z6 g8 ~6 R
Wire SRAM_A0
& ^# A0 s- z# l# W7 D, NNet label SRAM_A0
0 _4 X$ y4 o" D2 o% LSheet Entry U_SRAM-Interface SRAM_A0(passive)
& i2 ~$ h7 ]! E' a7 z
4 _+ _5 W! n# h# W+ v5 I, F3 }sheet symbol的图纸
! O. q: E0 Z# U; O. G
' o% R+ h; |' y! V& c5 y2 @4 q: x6 e( n( H  f
总的sheet的图纸
; h7 y6 z4 d- @5 f! U' K * N: ]" N) N* V( k6 c( x% Q0 E- k

" A$ J2 N* v) |  X% _+ S为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是warm,导入到PCB还是sram_a0, 不影响PCB layout! P# S4 q$ ~) C4 A0 S# J& h
很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦
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 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为/ y' y8 e1 r# b) \" j  t1 ~; T
Global (net label and port global). @0 u! }2 m$ F7 x( H: ^
编译错误会没有,但是这非我所愿,很纠结
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