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allegro PAD制作时警告

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发表于 2010-12-27 14:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro 16.3 在制作好PAD后保存会报警告如下:
7 j7 D5 x. K' Y/ ?
( A( H( D0 v' ^( \1 y/ Z; R2 s3 m* w& r% B' x2 T( J: n, z
PADSTACK WARNINGS:
+ m) u7 l' x8 y/ M1 ^) R1 |9 E. X; w6 h! w
INTERNAL LAYERS: are defined for this padstack.1 z; d0 O6 @- X0 g5 L6 M% g
When loading this padstack into a design, only the internal
& v7 j2 B# B# r+ nlayers with names matching those defined in the design will# @- d: R! e7 [. z
be used.
+ j% d- i3 T, O  N7 r
$ D1 t1 r) R/ k9 U: u帮我看看是什么原因造成的,对封装的制作有影响吗?
- D% `" v8 J* X8 i9 k

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 楼主| 发表于 2010-12-27 14:23 | 只看该作者
自己找到原因了,是在制作焊盘时我定义了DEFAULT INTERNAC层,然后又定义了GND层与VCC层,警告提示是只有DEFAULT INTERNAC的定义有用。

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发表于 2011-1-1 12:42 | 只看该作者
如果是通孔类的焊盘,别管你要做的PCB板是几层的,只要定义一个internal layer就可以了
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