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[Cadence Sigrity] Allegro Sigrity OptimizePI Training(四)仿真优化结果查看

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发表于 2016-7-29 17:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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Allegro Sigrity OptimizePI Training(四)仿真优化结果查看

4 \! B' h4 s5 x" u) M
本文大纲
1. 去耦电容仿真设置(一)
2. 去耦电容仿真设置(二)
3. 去耦电容仿真设置(三)
4.仿真优化结果查看

- q' \( E8 g$ Z9 U8 W
6 r" n, b; p! I0 c7 c/ K$ b7 W; y3 {. j0 l( Z0 G& G( N+ R
关于OptimizePI
      去耦电容的优化需要综合考虑PDN的性能和成本因素,在目前的PCB或封装设计中,往往存在PDN电源噪声(包括低频和高频)超标、性能不满足设计、成本较高等问题。随着设计变得越来越复杂,电容的位置和容值选择往往大大超出设计人员的经验。
       OptimizePI提供业界第一个能够综合考虑电源PDN性能和成本的解决方案。OptimizePI使用专利的电磁分析和优化算法,可以快速、准确地进行电源分析,自动排列组合去耦电容的容值和位置,提供兼顾性能和成本的电容优化方案,根据优化的不同目标,帮助设计人员在成本、空间、数量和性能之间做出权衡。OptimizePI提供交互式的优化结果后处理,方便用户直观地选择优化结果

, M: E6 R6 `, O1 ?1 a
9 Z% m0 ]2 U- u. ^9 v& H5 Y仿真优化结果查看
' n8 m% V  D2 w, ]- g
6 C3 V" Q* ^7 }: t5 `
本模块用到的PCB案例:
1. 6层PCB设计,第2层是地平面、第5层是电源平面
2.1个电源网络:VCC(红色显示网络)
3.1个地网络:GND(绿色显示网络)
4.1个VRM、5个IC器件(阻抗观测点)、28个去耦电容

" Z  y9 i& Y/ U0 g% L: Z
0 q6 X: I. e3 Z4 f4 P

' g9 R( v* p" J6 t$ U4 p+ j2 x6 G4 Z7 {6 s
本模块中,我们将会用OptimizePI分析不同的电容滤波方案对几个IC器件的电源阻抗的影响,从OptimizePI推荐的方案中选择合适的方案优化PDN设计。

3 o9 }1 D' L& Y* W
30. 在仿真结果区域上边的下拉列表中,选择All Observation and VRM Ports,显示所有观测点位置的阻抗。(没有修改的话,默认显示的是第一个观测点的阻抗)
. G# e* p0 r. w5 q+ r5 {
% ?* n! z& y& I! S8 Q+ M. d
31. 在左边的电容方案列表中,用鼠标或者键盘的方向键,浏览不同的电容方案,在右边的窗口观察相应的综合性能、电容成本、阻抗曲线的变化情况。把鼠标悬停在电容方案列表区域,可以查看对应电容方案使用的电容类型和数量。
# w9 N! Q1 t* z1 `
以Scheme 37为例,在性能vs成本曲线窗口,可以看到这个方案的PDN性能和电容成本都优于原始电容方案。在频域阻抗窗口,可以看到在100KHz-100MHz频段,这个方案的阻抗曲线比原始方案更平坦,平均阻抗也越小。

4 }, N) e. Q; c6 x4 k

/ F7 m6 `2 G0 t# s6 V3 F$ E$ k
32. 在Workflow中选择“Export Scheme Data”

/ ^* }. [- S& N* V1 w5 z

) n* f" N: r# \9 c
在Scheme Data Export窗口,选择Scheme 37,输出这个方案的电容优化详细结果。Output Files勾选“SPD File”,输出电容优化后的spd文档,勾选“Placement Table for All Optimization Schemes”,输出所有方案的电容配置表格。点击OK确认。

- K8 V% i$ g  i" U/ X; r
) M1 Y4 k; U  ~; M
在弹出的“Comment for BNP File”窗口输入注释信息,点击OK确认。

" n1 O1 I% [, ~$ ?8 d, Y2 z$ J. j' W

  {6 s3 i% S. w$ D4 }
33. 查看D:\Training\Sigrity_OptimizePI\Lab\Module1\demo\目录下的输出文件如下。
demo_Device_Optimization_OptimumDefault_Scheme37_Decap_Report.txt:

% B2 B! M# r- N2 K9 {  T

3 g% O1 ]( u9 k8 b- w$ y
demo_Device_Optimization_Placements.xls:

$ W/ d8 M% F6 D8 n: ]

4 n( X' l+ E3 |  [5 j( j7 I$ U
34. 在Workflow中点击“Draw Capacitor Placement”,Color Map选择“Capacitor”,查看对应方案的电容分布。

- E; }" d' U2 p! p6 L/ C- n# _

4 q4 {% x0 |' d' {$ P6 \; b. Z( f7 ?" u
2 `$ n5 M  I& M4 ^9 F- Q
可以在色标条区域右键菜单选择用Log Scale或者Linear Scale显示电容容值。
) {3 ~% ^& y; f4 J
8 o* S' C6 t- ?. ]8 D% a8 |
35. Color Map选择“Loop Inductance”,查看每个电容的fanout环路电感大小。

- f- B1 c! u/ x0 B
# G& h. y; t9 p  h
36. 在Workflow中点击“Create Report”,选择需要添加到报告中的内容,点击OK生成报告。

* Z. @% H& u) o ! f) O6 a# j2 O. N4 _, a8 o, l8 c$ x
$ Y( @9 |3 k: T( K) G- x

3 a% Z* T. K) e7 C  y6 Z
37. 查看仿真报告内容如下。

1 ?: t+ F* _$ Z$ v8 @* a

; ]2 t$ @' L/ A$ _- z9 w$ s7 ?8 \4 k9 Z* w+ ^

' f+ q+ q# P. v6 \
, o- G: y  r3 h# @$ J  d. R
7 Q* G2 O; o! g
38. 在菜单栏选择File->Save As(*.htm),保存仿真报告为“OptimizePI_Device_Optimization_Report.htm”。

1 U- M* I. a: @

: i/ M% U  d- r. B
39. 点击软件右上角的图标 ,在弹出的对话框中选择保存并关闭软件。
" f! H& e( \% a1 l  j) K3 ?
-----本文完----6 }8 `  v7 B6 t0 N8 s/ x, {
, ~( e3 T; c1 ~1 u% @9 m: G

0 B' _' P0 o, _, K6 M) [) n: B% s

, ]. a8 @# ^* F8 `) r
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发表于 2016-8-16 17:34 | 只看该作者
学习了,非常欢迎版主基础性的文章,版主真的辛苦了,写了这么多教程,是我们这些初学者的福利呀。版主可以出书了。

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发表于 2016-9-7 16:21 | 只看该作者
: E! T  X- O: C! W  y
果然是神key!谢谢楼主分享!

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发表于 2016-9-18 14:18 | 只看该作者
受益匪浅,谢谢。

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发表于 2016-9-18 17:48 | 只看该作者
謝謝分享

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发表于 2016-12-8 16:30 | 只看该作者
厉害

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发表于 2017-2-9 16:35 | 只看该作者
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发表于 2017-7-27 16:42 | 只看该作者
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